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文檔簡介

模擬CMOS集成電路設(shè)計

DesignofAnalogCMOSIC廖午陽

微電子技術(shù)系Whatisthiscourseabout?2這門課是關(guān)于：晶體管級的模擬集成電路設(shè)計（使用CMOS工藝）教材模擬CMOS集成電路設(shè)計，[美]畢查德.拉扎維著，陳貴燦程軍張瑞智等譯，西安交通大學(xué)出版社參考教材AnalysisandDesignofAnalogIntegratedCircuits，PaulR.GrayCMOS模擬電路設(shè)計，P.E.Allen

3第1章

緒論模擬集成電路的重要性模擬集成電路設(shè)計的難點和流程一般概念抽象級別健壯性設(shè)計符號約定5WhyAnalog？

—模擬電路的重要性和應(yīng)用領(lǐng)域6高速度、高精度、低功耗的模數(shù)轉(zhuǎn)換器信號太小時需要先放大濾除信號頻帶外的干擾自然界信號（模擬量）7模擬集成電路的應(yīng)用模擬電路設(shè)計的難點設(shè)計關(guān)注點多：包括速度、功耗、增益、精度、電源電壓等；數(shù)字電路主要是速度、功耗高精度模擬電路對低噪聲、低串?dāng)_、抗干擾等要求很高；數(shù)字電路在這方面要求低很多器件的二階效應(yīng)對電路性能影響大；對工藝參數(shù)變化的敏感度比數(shù)字電路高很多設(shè)計的自動化程度低，很多靠手工設(shè)計；數(shù)字電路設(shè)計自動化程度高模擬電路的建模和仿真難度大，對設(shè)計者經(jīng)驗和直覺的要求高910模擬集成電路的設(shè)計開發(fā)流程電路設(shè)計版圖設(shè)計封裝測試11電路設(shè)計WhyCMOS？與雙極工藝(BJT)相比優(yōu)點輸入阻抗大，加工成本低，低功耗，易于按比例縮小，易于實現(xiàn)數(shù)?；旌想娐罚ㄊ荢OC較佳選擇），設(shè)計自由度大（小信號特性依賴于器件尺寸和直流偏量，雙極只依賴于直流偏量）缺點低增益，速度慢（在改善，幾十GHz），噪聲大（也在改善）13抽象級別14抽象級別為什么要抽象？我們關(guān)心的對象或感興趣的程度是變化的把復(fù)雜度控制在一定范圍內(nèi)抽象級別器件級晶體管級（電路級）結(jié)構(gòu)級系統(tǒng)級AIC設(shè)計師應(yīng)能在不同抽象級間自由切換成功的高性能IC都是分工協(xié)作、優(yōu)勢匯總的結(jié)果，IC設(shè)計師需要學(xué)會協(xié)作15符號信號直流偏置信號交流小信號總信

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