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文檔簡介

實驗十一MSI計數(shù)器的應用(二)

教材P309的實驗五的實驗任務3用MSI計數(shù)器74HC161(或74LS161)及74HC10、74HC04（或74LS10、74LS04）組成一個起始狀態(tài)為0的60進制同步加法計數(shù)器,并測試其輸入和輸出的同步波形（在QUARTUSII7.2軟件中仿真測試）,以檢測電路的邏輯功能是否正確

。

補充：利用上述芯片設計按照BCD碼計數(shù)規(guī)律的M=60，起始為0的同步計數(shù)器集美大學通信工程方怡冰利用輸出3B作為共同的預置信號集美大學通信工程方怡冰集美大學通信工程方怡冰集美大學通信工程方怡冰0-59的M=60計數(shù)器集美大學通信工程方怡冰集美大學通信工程方怡冰實驗十二用PLD設計時序邏輯電路(三)教材P334的實驗八的實驗任務1、21.用PLD設計一個能夠自啟動的依次循環(huán)出“1”和依次循環(huán)出“0”的可控移存型8位脈沖分配器,并用實驗方法檢測設計是否正確。2.用PLD設計一個移存型序列信號發(fā)生器,用來產(chǎn)生0111，0011，01序列信號,并檢測其設計輸出信號是否正確。集美大學通信工程方怡冰任務1集美大學通信工程方怡冰分配輸出高、低電平控制電路集美大學通信工程方怡冰分配輸出為0分配輸出為1集美大學通信工程方怡冰任務2：產(chǎn)生0111，0011，010111，0011，01序列信號4位一組：0111，1110，1100，1001，0011，0110，1101，1010，0101，1011，共10組不重疊，所以K取4設計移存型序列信號發(fā)生器。Q3Q2Q1Q000011110001011011100110101集美大學通信工程方怡冰集美大學通信工程方怡冰集美大學通信工程方怡冰任務2：產(chǎn)生011

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