LDPC編譯碼的DSP實(shí)現(xiàn)_第1頁
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LDPC編譯碼的DSP實(shí)現(xiàn)_第3頁
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文檔簡介

1、LDPC編譯碼的 DSP實(shí)現(xiàn)低密度奇偶校驗(yàn)碼 (LDPC, Low Density Parity Codes)是一種能逼近Shannon容量限的漸進(jìn)好碼 , 在長碼時(shí)其性能甚至超越Turbo 碼。 LDPC碼的譯碼采用的是基于置信傳播的軟輸出迭代譯碼算法, 復(fù)雜度低 , 是一種次優(yōu)的譯碼算法。由于低密度奇偶校驗(yàn)碼具有諸多優(yōu)點(diǎn), 它在信息可靠傳輸中的良好應(yīng)用前景已經(jīng)引起學(xué)術(shù)界和IT 業(yè)界的高度重視 , 成為當(dāng)今信道編碼領(lǐng)域最受矚目的研究熱點(diǎn)之一 , 低密度奇偶校驗(yàn)碼的應(yīng)用也已經(jīng)被提到日程上。本文對(duì) LDPC碼的研究以及創(chuàng)新成果主要體現(xiàn)在對(duì)譯碼算法的改進(jìn)與編譯碼算法的硬件實(shí)現(xiàn)兩方面。文章首先論述了

2、 LDPC碼的基本原理 , 在理解 LDPC碼基本編譯碼理論的基礎(chǔ)上 , 深入分析了 LDPC碼簡化譯碼算法的實(shí)現(xiàn)原理及性能表現(xiàn) , 進(jìn)而提出一種新的歸一化最小和譯碼算法。對(duì)各種算法譯碼性能的仿真結(jié)果表明 , 對(duì)于中短長度的規(guī)則 LDPC碼 , 本文提出的改進(jìn)算法 , 在增加很小計(jì)算復(fù)雜度與譯碼迭代次數(shù)的前提下 , 可獲得好于經(jīng)典 LLR BP譯碼算法的性能。其次 , 根據(jù)實(shí)際應(yīng)用需求 , 有別于以往采用的 FPGA+DSP的 LDPC碼編譯碼實(shí)現(xiàn)方法 , 本文提出并實(shí)現(xiàn)了集 LDPC碼編碼與譯碼功能為一體的基于 DSP的 LDPC編譯碼器 , 從而降低系統(tǒng)硬件成本。 針對(duì)實(shí)現(xiàn)過程中遇到的問題 , 文章給出了有效的數(shù)值存儲(chǔ)方法、矩陣運(yùn)算方法以及編程技巧 , 并對(duì)優(yōu)化后的結(jié)果進(jìn)行了分析。最后 , 開發(fā)了基于 Labwindows/CVI 的 LDPC編譯碼器測(cè)試平臺(tái) , 該平臺(tái)為用戶提供簡潔清晰的人機(jī)交互界面 , 具有串口參數(shù)設(shè)置、信源產(chǎn)生、信道模擬、編譯碼進(jìn)度、結(jié)果分析及顯示等

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