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實(shí)用標(biāo)準(zhǔn)文案實(shí)用標(biāo)準(zhǔn)文案精彩文檔精彩文檔華中科技大學(xué)實(shí)驗(yàn)報(bào)告實(shí)驗(yàn)名稱 雙端口存儲(chǔ)器原理實(shí)驗(yàn) 成實(shí)驗(yàn)日期 第 2 次試驗(yàn) 指導(dǎo)老師陳國(guó)平專業(yè) 計(jì)科 班號(hào) 組別學(xué)生姓名 同組學(xué)生一、實(shí)驗(yàn)?zāi)康腎DT7132了解半導(dǎo)體存儲(chǔ)器怎樣存儲(chǔ)和讀取數(shù)據(jù)。了解雙端口存儲(chǔ)器怎樣并行讀寫,并分析沖突產(chǎn)生的情況。二、實(shí)驗(yàn)電路數(shù)據(jù)顯示燈 指令顯示燈RAM-BUS#LR/W#
D7D6D5D4D3D2D1D0 I7I6I5I4I3I2I1雙端口存儲(chǔ)器
OER#(GND)T2CEL#
(IDT7132) RRW(Vcc)CER#地址顯示LDAR#AR+1T2
A7A6A5A4A3A2A1A0 PC7 AR(74LS163) PC(74LS163)
地址顯示LDPC#PC+1T2三態(tài)門(244)SW7 SW0數(shù)據(jù)開關(guān)圖3.2雙端口存儲(chǔ)器實(shí)驗(yàn)電路圖3.2IDT713(2048×8,A8-A10256DBUS,IBUS。IDT7132LR/W#OELCER#RR/W#OER#CELLR/W#OELCER#、RR/W#、OER#控制右端口的讀寫操作。CEL#為左CEL#=1LR/W#控LR/W#=1OEL#的作用等同于三態(tài)門,當(dāng)OEL#=0DBUSOEL#=1DBUS。因此,為便于理解,在以O(shè)EL#RAM_BUS#??刂朴叶丝诘娜齻€(gè)引腳與左端口的三個(gè)完全類似,這里不再贅述。有兩點(diǎn)需要說明:右端口讀出的數(shù)據(jù)(更確切的說法是指令)IBUSDBUS,IR。所有數(shù)據(jù)/指令的寫入都使用左端口,右端口作為指令端口,不需要進(jìn)行RR/W#固定接地。這兩點(diǎn)請(qǐng)同學(xué)好好理解。ARPC274LS163,臺(tái)操作板上的二進(jìn)制開關(guān)分時(shí)給出。LDAR#=0T2DBUSSW7-SW0AR+1=1T21LDAR#AR+1CEL#=0,LR/W#=0,T2SW7-SW07DBUS寫入存儲(chǔ)器。三、實(shí)驗(yàn)任務(wù)3.2后接通電源。SW7-SW0(SW0)00H,將其作為存儲(chǔ)器AR;00HRAM10H、20H、30H、40H10H、20H、30H40H。25入的數(shù)據(jù)是否正確。記錄數(shù)據(jù)。注意:禁止兩個(gè)或兩個(gè)以上的數(shù)據(jù)源同時(shí)向AR25步結(jié)果相同。記錄數(shù)據(jù)。雙端口存儲(chǔ)器的并行讀寫和訪問沖突。CEL#CER#0,使存儲(chǔ)器的左右端口同時(shí)被選中。當(dāng)ARPCBUSYL#BUSYR#BUSYL#/BUSYR(時(shí),不一定發(fā)生沖突,但發(fā)生沖突時(shí),BUSYL#/BUSYR#必定亮。四、實(shí)驗(yàn)要求IDT7132寫出實(shí)驗(yàn)報(bào)告,內(nèi)容是:實(shí)驗(yàn)?zāi)康摹?45五、實(shí)驗(yàn)步驟1.置DP=1,DB=0,編程開關(guān)撥到正常位置。按電路圖要求,將有關(guān)控制信號(hào)和二進(jìn)制開關(guān)對(duì)應(yīng)接好,反復(fù)檢查后,接通電源。數(shù)據(jù)通路LDAR#LDPC#CEL#LR/W#RAM_BUS#CER#SW_BUS#電平開關(guān)K0K1K2K3K4K5K6AR+1和PC+1兩個(gè)信號(hào)接地.3.SW7-SW0(SW000H,AR;00HRAM10H,20H,30H,40H10H,20H,30H,40H.00H,10H,20H,30H,40H00H,10H,20H,30H,40H.(1)K0(LDAR#)=0,K2(CEL#)=1,K4(RAM_BUS#)=1,K5(CER#)=1,K6(SW_BUS#)=0.數(shù)據(jù)通路LDAR#LDPC#CEL#LR/W#RAM_BUS#CER#SW_BUS#電平開關(guān)K0K1K2K3K4K5K6狀態(tài)0×1×110置SW7-SW0=00H,SW7SW6SW5SW4SW3SW2SW1SW000000000按QD按鈕,將00H打入地址寄存器AR.(2)K0(LDAR#)=1,K2(CEL#)=0,K3(LR/W#)=0,K4(RAM_BUS#)=1,K5(CER#)=1,K6(SW_BUS#)=0.數(shù)據(jù)通路數(shù)據(jù)通路LDAR#LDPC#CEL#LR/W#RAM_BUS#CER#SW_BUS#電平開關(guān)K0K1K2K3K4K5K6狀態(tài)1×00110置SW7-SW0=00H,SW7SW6SW5SW4SW3SW2SW1SW000000000按QD按鈕,將00H寫入存儲(chǔ)器00H單元.(3)12SW7-SW010H,20H,30H,40H10H,20H,30H,40H10H,20H,30H,40H.實(shí)驗(yàn)數(shù)據(jù)記錄表:存儲(chǔ)單元地存儲(chǔ)單元地址00H10H20H30H40H存儲(chǔ)單元數(shù)據(jù)/00H10H20H30H40H25(注意:禁止兩個(gè)或兩個(gè)以上的數(shù)據(jù)源同時(shí)向數(shù)據(jù)總線上發(fā)送數(shù)SW_BUS#AR送入數(shù)據(jù)時(shí),雙端口存儲(chǔ)器也不能被選中.)任務(wù):從左端口讀出存儲(chǔ)器00H,10H,20H,30H,40H的內(nèi)容.(1)K0(LDAR#)=0,K2(CEL#)=1,K4(RAM_BUS#)=1,K5(CER#)=1,K6(SW_BUS#)=0.數(shù)據(jù)通路LDAR#LDPC#CEL#LR/W#RAM_BUS#CER#SW_BUS#電平開關(guān)K0K1K2K3K4K5K6狀態(tài)0×1×110置SW7-SW0=00H,SW7SW6SW5SW4SW3SW2SW1SW000000000按QD按鈕,將00H打入地址寄存器AR.(2)先令K6(SW_BUS#)=1,再令K2(CEL#)=0,K3(LR/W#)=1,K4(RAM_BUS#)=0,K5(CER#)=1,則在數(shù)據(jù)總線DBUS上顯示出存儲(chǔ)器單元00H的內(nèi)容00H。(3)121SW7-SW010H,20H,30H,40HDBUS10H,20H,30H,40H實(shí)驗(yàn)結(jié)果記錄表1:00H00H0000000010H10H0001000020H20H0010000030H30H0011000040H40H01000000存儲(chǔ)單元地址存儲(chǔ)單元數(shù)據(jù)/指令DBUS2存儲(chǔ)單元地址存儲(chǔ)單元數(shù)據(jù)/指令DBUS任務(wù):從右端口讀出存儲(chǔ)器00H,10H,20H,30H,40H的內(nèi)容.(1)K1(LDPC#)=0,K2(CEL#)=1,K4(RAM_BUS#)=1,K5(CER#)=1,K6(SW_BUS#)=0.數(shù)據(jù)通路LDAR#LDPC#CEL#LR/W#RAM_BUS#CER#SW_BUS#電平開關(guān)K0K1K2K3K4K5K6狀態(tài)×01×110置SW7-SW0=00H,SW7SW6SW5SW4SW3SW2SW1SW000000000按QD按鈕,將00H打入PC.令K6(SW_BUS#)=1,K2(CEL#)=1,K5(CER#)=1IBUS00H00H.121SW7-SW010H,20H,30H,40HIBUS10H,20H,30H,40H存儲(chǔ)單元地址存儲(chǔ)單元地址存儲(chǔ)單元數(shù)據(jù)/指令I(lǐng)BUS00H00H0000000010H10H0001000020H20H0010000030H30H0011000040H40H01000000雙端口存儲(chǔ)器的并行讀寫和訪問沖突。(1)K0(LDAR#)=0,K1(LDPC#)=0,K2(CEL#)=1,K4(RAM_BUS#)=1,K5(CER#)=1,K6(SW_BUS#)=0.數(shù)據(jù)通路LDAR#LDPC#CEL#LR/W#RAM_BUS#CER#SW_BUS#電平開關(guān)K0K1K2K3K4K5K6狀態(tài)001×110SW7-SW0=30H,SW7SW6SW5SW4SW3SW2SW1SW000110000按QD按鈕,將30H打入地址寄存器AR和程序計(jì)數(shù)器PC.(2)置K6(SW_BUS#)=1,K3(LR/W#)=1,K4(RAM_BUS#)=0.先令K5(CER#)=0,K2(CEL#)=1BUSYL#K2(CEL#)=0,BUSYL#DBUS30H,IBUS30H.K2(CEL#)=1,BUSYL#指示燈恢復(fù)不亮.(3)置K6(SW_BUS#)=1,K3(LR/W#)=1,K4(RAM_BUS#)=0.先令K2(CEL#)=0,K5(CER#)=1,BUSYRK5(CER#)=0,BUSYR#DBUS30H,I
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