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2024年福建開(kāi)放大學(xué)《數(shù)字電子電路》形成性考核試題庫(kù)(含答案)1.函數(shù)F(A,B,C)=AB+AC的最小項(xiàng)表達(dá)式為()。B、選項(xiàng)缺失2.若在編碼器中有50個(gè)編碼對(duì)象,則要求輸出二進(jìn)制代碼位數(shù)為()位。4.如需要判斷兩個(gè)二進(jìn)制數(shù)的大小或相等,可以使用()電路。5.邏輯數(shù)F=AB+BC,當(dāng)變量的取值為()時(shí),將出現(xiàn)冒險(xiǎn)現(xiàn)象。6.對(duì)電壓、頻率、電流等模擬量進(jìn)行數(shù)字處理之前,必須將其進(jìn)行()。7.數(shù)據(jù)分配器輸入端的個(gè)數(shù)是()。8.N個(gè)觸發(fā)器可以構(gòu)成能寄存()位二進(jìn)制數(shù)碼的寄存器。9.當(dāng)溫度升高時(shí),二極管的反向飽和電流將()。C、減小10.將二進(jìn)制、八進(jìn)制、十六進(jìn)制數(shù)轉(zhuǎn)換為十進(jìn)制數(shù)的共同規(guī)則是()。B、乘十取整11.數(shù)字電路中使用的數(shù)制是()。A、十進(jìn)制13.在下列邏輯電路中,不是組合邏輯電路的是()。16.二進(jìn)制數(shù)1111100.01對(duì)應(yīng)的十進(jìn)制數(shù)為()。17.若要設(shè)計(jì)一個(gè)脈沖序列為1101001010的序列脈沖發(fā)生器,應(yīng)選用()個(gè)觸發(fā)21.一片容量為1024字節(jié)×4位的存儲(chǔ)器,表示有()個(gè)存儲(chǔ)單元。22.對(duì)于JK觸發(fā)器,若J=K,則可完成()觸發(fā)器的邏輯功能。A、RS23.RS觸發(fā)器的約束條件是()。24.下圖四環(huán)電阻的阻值應(yīng)該是()。25.構(gòu)成四位寄存器應(yīng)選用()。B、4個(gè)觸發(fā)器C、16個(gè)觸發(fā)器26.一個(gè)16選一的數(shù)據(jù)選擇器,其地址輸入(選擇控制輸入)端的個(gè)數(shù)是()。27.石英晶體振蕩器的振蕩頻率取決于()。28.時(shí)序邏輯電路中一定包含()。29.標(biāo)準(zhǔn)與或式是由()構(gòu)成的邏輯表達(dá)式。30.若4位同步二進(jìn)制加法計(jì)數(shù)器當(dāng)前的狀態(tài)是0111,下一個(gè)輸入時(shí)鐘脈沖后,其內(nèi)容變?yōu)?)。31.把一個(gè)二進(jìn)制計(jì)數(shù)器與一個(gè)九進(jìn)制計(jì)數(shù)器串聯(lián)可得到()進(jìn)制計(jì)數(shù)器。32.下列電路中,不屬于組合邏輯電路的是()。B、全加器C、寄存器D、編碼器33.n個(gè)變量可以構(gòu)成()個(gè)最小項(xiàng)。34.引起組合邏輯電路中竟?fàn)幣c冒險(xiǎn)的原因是()。D、電源不穩(wěn)定35.以下表達(dá)式中符合邏輯運(yùn)算法則的是()。36.同步時(shí)序邏輯電路和異步時(shí)序邏輯電路比較,其差別在于后者()。B、沒(méi)有統(tǒng)一的時(shí)鐘脈沖控制D、輸出只與內(nèi)部狀態(tài)有關(guān)37.下列信號(hào)中,()是數(shù)字信號(hào)。B、2片C、3片45.以下門(mén)電路中常用于總線傳輸?shù)臑?)。A、BC48.當(dāng)晶體管工作在放大區(qū),發(fā)射結(jié)電壓和集電結(jié)電壓應(yīng)為()。49.如若要求集成運(yùn)放作寬頻帶放大器,那么集成運(yùn)放的應(yīng)選用什么型的?A、交流電壓51.一個(gè)T觸發(fā)器,在T=1時(shí),加上時(shí)鐘脈沖,則觸發(fā)器()。C、置154.若輸入變量A、B全為1時(shí),輸出F=0,則其輸入與輸出關(guān)系是()。56.用8421碼表示的十進(jìn)制數(shù)65,可以寫(xiě)成()。59.若由PNP型管組成的共射電路中,輸出電壓波形如圖所示,電路產(chǎn)生了什么61.十六路數(shù)據(jù)選擇器,其地址輸入端有()個(gè)。62.在CP作用下,欲使T觸發(fā)器具有=的功能,其T端應(yīng)接()。63.標(biāo)準(zhǔn)與或式是由()構(gòu)成的邏輯表達(dá)式。64.十進(jìn)制數(shù)24用8421BCD碼表示為()。65.二輸入端的或非門(mén),其輸入端為A、B,輸出端為Y,則其表達(dá)式Y(jié)=()。66.下列觸發(fā)器中沒(méi)有約束條件的是()。B、主從RS觸發(fā)器A、上升(下降)沿68.在同步計(jì)數(shù)器中,各觸發(fā)器狀態(tài)改變時(shí)刻()。D、與電平相同69.以下代碼中為無(wú)權(quán)碼的為()。A、8421BCD70.下列哪個(gè)是數(shù)據(jù)選擇器()。C、N型半導(dǎo)體72.具有“線與”邏輯功能的門(mén)電路有()。D、或門(mén)73.N個(gè)觸發(fā)器可以構(gòu)成最大計(jì)數(shù)長(zhǎng)度(進(jìn)制數(shù))為()的計(jì)數(shù)器。74.組合邏輯電路通常由()組合而成。75.JK觸發(fā)器欲在CP作用后保持原狀態(tài),則JK的值是()。多選題1.基本邏輯門(mén)有()、()和()三種。2.0C門(mén)的輸出端可并聯(lián)使用,實(shí)現(xiàn)()功能;三態(tài)門(mén)可用來(lái)實(shí)現(xiàn)()。6.單穩(wěn)態(tài)觸發(fā)器狀態(tài)有一個(gè)()和一個(gè)()。B、暫穩(wěn)狀態(tài)C、不穩(wěn)定狀態(tài)7.鎖存器是一種對(duì)脈沖()敏感存儲(chǔ)單元電路,而觸發(fā)器是一種對(duì)脈沖()敏感8.時(shí)序邏輯電路按觸發(fā)器時(shí)鐘端的連接方式不同可以分為()時(shí)序邏輯電路和()時(shí)序邏輯電路兩類(lèi)。9.下面哪些是屬于只讀存儲(chǔ)器ROM的電路結(jié)構(gòu)()。10.二進(jìn)制數(shù)10111111對(duì)應(yīng)的十六進(jìn)制數(shù)為(),十進(jìn)制數(shù)為()。A、BF11.下列哪些元件不是線性元器件()。14.有一數(shù)碼10010011,作為自然二進(jìn)制數(shù)時(shí),下列十進(jìn)制數(shù)不正確的是()。16.數(shù)字電路中用“()”和“()”分別表示兩種狀態(tài),二者無(wú)大小之分。A、017.時(shí)序邏輯電路一定包含有作為存儲(chǔ)單元的(),時(shí)序電路中可以沒(méi)有()電路,但不能沒(méi)有()。18.時(shí)序邏輯電路的邏輯功能的特點(diǎn)是任何時(shí)刻電路的穩(wěn)定(),不僅和()有關(guān),而且還取決于()。A、輸出19.二進(jìn)制異步加計(jì)數(shù)器若用上升沿觸發(fā)的D觸發(fā)器組成,則應(yīng)將()位觸發(fā)器的端與相鄰()一位觸發(fā)器的時(shí)鐘信號(hào)CP相連。20.二進(jìn)制譯碼器相當(dāng)于是一個(gè)(),便于實(shí)現(xiàn)()。24.邏輯函數(shù)常用化簡(jiǎn)方法有()。25.在正邏輯的約定下,“1”表示(),“0”表示()。26.數(shù)字電路按邏輯功能的不同特點(diǎn)可分為兩大類(lèi),即:()邏輯電路和()邏輯27.若要構(gòu)成十進(jìn)制計(jì)數(shù)器,至少用()個(gè)觸發(fā)器,它有()個(gè)無(wú)效狀態(tài)。A、428.二階有源濾波器有哪些()。D、帶阻濾波器29.下列關(guān)于邏輯函數(shù)F=A+(A+B)=(),錯(cuò)誤的是?30.SR鎖存器的約束條件RS=()表示不允許出現(xiàn)RS=()的輸入。31.T觸發(fā)器具有()和()的邏輯功能。32.實(shí)現(xiàn)基本和常用邏輯運(yùn)算的(),稱(chēng)為(),簡(jiǎn)稱(chēng)()。33.時(shí)序邏輯電路按照其觸發(fā)器是否有統(tǒng)一的時(shí)鐘控制分為()時(shí)序電路和()34.單穩(wěn)態(tài)觸發(fā)器有兩個(gè)工作狀態(tài)()和(),其中()是暫時(shí)的。35.JK=01時(shí),具有()功能;JK=10時(shí),具有()功能。()等幾類(lèi)。()等幾類(lèi)。40.多級(jí)放大器級(jí)間耦合方式有()。41.8421BCD碼中的1011、1010代表十進(jìn)制數(shù)中的()。42.在邏輯電路中,三極管通常工作在()和()狀態(tài)。A、S1=144.若ROM有5根地址輸入線,有8根數(shù)據(jù)輸出線,則ROM的字線數(shù)為(),R0M的容量為()。45.邏輯函數(shù)兩次求反則還原,邏輯函數(shù)的()式再作()變換也還原為它本身。47.一個(gè)()的邏輯電路設(shè)計(jì)方案就是一個(gè)()的方案。48.JK觸發(fā)器在JK=00時(shí),具有()功能,JK=11時(shí);具有()功能。49.所謂時(shí)序邏輯電路是指電路的輸出不僅與當(dāng)時(shí)的()有關(guān),而且與電路的()50.邏輯函數(shù)的化簡(jiǎn)方法有()和()。53.漏極開(kāi)路(OD)門(mén)工作時(shí)必須外接()和()多個(gè)OD門(mén)輸出端并聯(lián)到一起可實(shí)現(xiàn)()功能。58.比較器是比較()的電路;全加器是實(shí)現(xiàn)(),并考()的邏輯電路。59.邏輯函數(shù)的表示方法中不具有唯一性的是()。62.時(shí)序邏輯電路按照其觸發(fā)器是否有統(tǒng)一的時(shí)鐘控制分為()時(shí)序電路和()63.組合電路由()構(gòu)成,它的輸出只取決于()而與原狀態(tài)無(wú)關(guān)。C、3個(gè)65.串行加法器的進(jìn)位信號(hào)采用()傳遞,并行加法器的進(jìn)位信號(hào)采用()傳遞。1.555定時(shí)器由(分壓器)、(比較器)、(基本RS觸發(fā)器)、(晶體管開(kāi)關(guān))和(輸出緩沖器)五部分組成。4.寄存器分為(基本寄存器)和(移位寄存器)兩種。5.把一個(gè)5進(jìn)制計(jì)數(shù)器與一個(gè)10進(jìn)制計(jì)數(shù)器串聯(lián)可得到15進(jìn)制計(jì)數(shù)器。6.多諧振蕩器是一種(自激振蕩)電路,它沒(méi)有(穩(wěn)態(tài)),只有兩個(gè)(暫穩(wěn)態(tài))。10.JK觸發(fā)器具有保持、置0、置1和翻轉(zhuǎn)的邏輯功能。11.在數(shù)字電路中,二進(jìn)制數(shù)碼的0和1不僅可以代表數(shù)量的大小,還可以表示12.兩個(gè)同位的加數(shù)和來(lái)自低位的進(jìn)位三者相加,叫做(全加器)。14.在負(fù)邏輯的約定下,“1”表示(低電平),“0”表示(高電平)變量的取值23.時(shí)序邏輯電路的邏輯功能的特點(diǎn)是任何時(shí)刻電路的穩(wěn)定(輸出),不僅和(該時(shí)刻的輸入信號(hào))有關(guān),而且還取決于(電路原來(lái)的狀態(tài))26.數(shù)字信號(hào)只有兩種取值,分別表示為1和2。35.T’觸發(fā)器具有(翻轉(zhuǎn))的邏輯功能。36.單穩(wěn)態(tài)觸發(fā)器狀態(tài)有一個(gè)(穩(wěn)定狀態(tài))和一個(gè)(暫穩(wěn)狀態(tài))。38.石英晶體多諧振蕩器的振蕩頻率僅決定于晶體本身的(諧振頻率),而與電路43.多諧振蕩器不需要外加觸發(fā)信號(hào),就能自動(dòng)的輸出(矩形)脈沖。44.可以通過(guò)置數(shù)法,給計(jì)數(shù)器置0,從而達(dá)到復(fù)位的目的。45.A/D轉(zhuǎn)換器是把(模擬量)轉(zhuǎn)換為(數(shù)字量)的轉(zhuǎn)換器。46.RAM與ROM比較,其優(yōu)點(diǎn)是(讀寫(xiě)方便,使用靈活);缺點(diǎn)是(掉電丟失信47.觸發(fā)器又稱(chēng)為雙穩(wěn)態(tài)電路,因?yàn)樗哂?兩個(gè))穩(wěn)定的狀態(tài)。48.根據(jù)邏輯功能不同,觸發(fā)器可分為RS觸發(fā)器、D器和T’觸發(fā)器等。59.能夠?qū)?1個(gè))輸入數(shù)據(jù),根據(jù)需要傳送到(m個(gè))輸出端的任意一個(gè)
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