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時(shí)序邏輯電路時(shí)序邏輯電路時(shí)序邏輯電路……x1x1xnz1z1znF組合邏輯電路…x1x1xnz1z1zn…時(shí)序邏輯電路的特點(diǎn):電路的輸出不但取決于電路的輸入,而且與電路原來(lái)的狀態(tài)有關(guān)——具有記憶作用?;締卧|發(fā)器SDD
QC
QRD
DQn+11100符號(hào)及狀態(tài)表TQn+10Qn1QnSDT
QC
QRD
T觸發(fā)器1.J—K→D觸發(fā)器SDJ
QCK
QRD
1D2.J—K→T觸發(fā)器SDJ
QCK
QRD
T3.D→T’觸發(fā)器SDD
QC
QRD
觸發(fā)器邏輯功能的轉(zhuǎn)換1.電平觸發(fā),high,low邊沿觸發(fā),↑,↓脈沖觸發(fā)(主-從)觸發(fā)器的觸發(fā)方式數(shù)碼寄存器(并入—并出)&ENQDQDQDQDENENEN&&&RDy3y2y1y0輸出指令寄存指令輸入指令x3x2x1x01
0
1
11
0
1
11
0
1
11
0
1
1其作用類似于RAM移位寄存器1.并入——串出移位寄存器并入——由SD端置入(寄存指令)串出——由Q3端輸出(3個(gè)CP后)注:必須先清零!Q3JQ3kQ2JQ2kQ1JQ1kQ0JQ0k1&&&&并行輸入1
0
1
1D3
D2D1D0
SDSDSDSDRDCP寄存指令1011串入——串出/并出移位寄存器Q3D3Q3
Q2D2Q2
Q1D1Q1
Q0D0Q0
并行輸出y3
y2y1y0
SDSDSDSDRDCP取出指令1011ENENENEN1011串行輸出串入——由D0輸入4個(gè)CP后,來(lái)“取出指令”可由y3~y0并行輸出再來(lái)3CP個(gè)后,在Q3端可得到串行碼輸出3.循環(huán)移位寄存器——Q3與D0相連可實(shí)現(xiàn)循環(huán)移位(左移、右移、雙向)Notice1)異步——各出發(fā)器不同時(shí)接CP——不同時(shí)翻轉(zhuǎn)2)計(jì)數(shù)器不僅僅可以計(jì)數(shù),而且有多種用途
a)計(jì)數(shù)——CP周期可以不恒定
b)定時(shí)——CP周期恒定
c)分頻——從Q0、Q1、Q2分別可以得到2、4、8分頻信號(hào)3)對(duì)于后沿觸發(fā)的觸發(fā)器,后級(jí)的CP只能接到前級(jí)的Q而不是Q端,否則將出錯(cuò)常用TTL74
系列集成寄存器*1)基本寄存器A)多位D觸發(fā)器:175,173,174,177,374B)鎖存器:375,278,116,373C)寄存器陣列:170,670,1722)移位寄存器A)單向移位寄存器:195,395,164,165,166,199B)雙向移位寄存器:194,95,1985.常用CMOS
4000
系列集成寄存器1)基本寄存器:CC4042,CC40174,CC45082)移位寄存器:A)單向:CC14006,CC4015,CC4014,CC4021,CC4035,CC40195B)雙向:CC40194,CC4034一、二進(jìn)制計(jì)數(shù)器1.異步二進(jìn)制加法計(jì)數(shù)器CPQ2Q1Q0DecRD00001001120102301134100451015611067111780000QJQ
kQJQ
kQJ
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