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文檔簡介
1學習情境五測試題（2）1.基于EDA軟件的FPGA/CPLD設計流程，以下流程中哪個是正確的：。A.原理圖/HDL文本輸入→適配→綜合→時序仿真→編程下載→功能仿真→硬件B.原理圖/HDL文本輸入→功能仿真→綜合→時序仿真→編程下載→適配→硬件C.原理圖/HDL文本輸入→功能仿真→綜合→適配→時序仿真→編程下載→硬件D.原理圖/HDL文本輸入→適配→時序仿真→編程下載→功能仿真→綜合→硬件A.綜合就是把抽象設計層次中的一種表示轉化成另一種表示的過程,并且該過程C.綜合可以理解為將軟件描述與給定的硬件結構用電路網表文件表示的映射過程，映射結果不唯一2C.ifrising_edge(clk)A.一位熱碼編碼B.格雷碼編碼A.三態(tài)控制電路B.條件相或的邏3D.一個進程可以同時描述多個時鐘信號的A.2#1111_1110#B.8#276#C.10#170#D.161.VHDL與一般編程語言類似，有自己的語法規(guī)制，但與一般編程語2.MAX+plusⅡ的元件符號文件能被QuartusⅡ打開并讀取，但不能進行修改。9.國際上生產FPGA/CPLD的主流公司，并且在國內占有市場份額較大的主要是410
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