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1.設(shè)計(jì)題目
采用FPGA設(shè)計(jì)一4×4鍵盤編碼器。當(dāng)按鍵有效時(shí),DAV產(chǎn)生由高到低的跳變,同時(shí)輸出4位鍵值B3~B0。KEYCLK為鍵盤接口的時(shí)鐘信號(hào)。9.4.34×4鍵盤編碼器設(shè)計(jì)2.任務(wù)一:按鍵的計(jì)數(shù)實(shí)驗(yàn)moduleCNT16(CLK,QQ);inputCLK;output[3:0]QQ;reg[3:0]QQ;always@(posedgeCLK)beginQQ<=QQ+4'b0001;end endmodule(1)16進(jìn)制計(jì)數(shù)器:9.4.34×4鍵盤編碼器設(shè)計(jì)(2)顯示譯碼器moduleLED7S(DIN,Y);input[3:0]DIN;output[6:0]Y;reg[6:0]Y;always@(DIN)begincase(DIN)4'b0000:Y=7'b0111111;//顯示“0”4'b0001:Y=7'b0000110;//顯示“1”4'b0010:Y=7'b1011011;//顯示“2”4'b0011:Y=7'b1001111;//顯示“3”4'b0100:Y=7'b1100110;//顯示“4”4'b0101:Y=7'b1101101;//顯示“5”4'b0110:Y=7'b1111101;//顯示“6”4'b0111:Y=7'b0000111;//顯示“7”4'b1000:Y=7'b1111111;//顯示“8”4'b1001:Y=7'b1101111;//顯示“9”4'b1010:Y=7'b1110111;//顯示“A”4'b1011:Y=7'b1111100;//顯示“b”4'b1100:Y=7'b0111001;//顯示“C”4'b1101:Y=7'b1011110;//顯示“d”4'b1110:Y=7'b1111001;//顯示“E”4'b1111:Y=7'b1110001;//顯示“F”default:Y=7'b0000000;endcaseend
endmodule9.4.34×4鍵盤編碼器設(shè)計(jì)3.任務(wù)二:按鍵消抖實(shí)驗(yàn)≈1kHz9.4.34×4鍵盤編碼器設(shè)計(jì)moduleDEBOUNCER(CLK,KA,KOUT);inputCLK,KA;outputKOUT;reg[4:0]Q;always@(posedgeCLK)beginif(KA==1)beginQ<=5'b00000;end(1)消抖計(jì)數(shù)器消抖計(jì)數(shù)器是一個(gè)具有同步清零和保持功能的16進(jìn)制計(jì)數(shù)器。異步清零elseif(Q==16)beginQ<=5'b10000;endelsebeginQ<=Q+1'b1;endendassignKOUT=~Q[4];endmodule保持9.4.34×4鍵盤編碼器設(shè)計(jì)(2)分頻電路moduleFREDIV64(CLK,CO);inputCLK;outputCO;reg[5:0]Q;wireCO;always@(posedgeCLK)beginQ<=Q+6'b1;endassignCO=Q[5];endmodule9.4.34×4鍵盤編碼器設(shè)計(jì)4.任務(wù)三:4×1鍵盤編碼器實(shí)驗(yàn)鍵值次數(shù)9.4.34×4鍵盤編碼器設(shè)計(jì)(1)優(yōu)先編碼器moduleENCODER(Y0,Y1,KA,I0,I1,I2,I3);outputY0,Y1,KA;inputI0,I1,I2,I3;reg[1:0]YTEMP;always@(I0orI1orI2orI3)beginif(!I0)YTEMP=2'b00;elseif(!I1)YTEMP=2'b01;elseif(!I2)YTEMP=2'b10;elseif(!I3)YTEMP=2'b11;elseYTEMP=2'b00;endassignY0=YTEMP[0];assignY1=YTEMP[1];assignKA=I0&I1&I2&I3;endmodule9.4.34×4鍵盤編碼器設(shè)計(jì)(2)寄存器moduleKEYREG(D,Q,CLK);output[3:0]Q;input[3:0]D;inputCLK;reg[3:0]Q;always@(posedgeCLK)begin Q<=D;endendmodule9.4.34×4鍵盤編碼器設(shè)計(jì)5.任務(wù)四:4×4鍵盤編碼器實(shí)驗(yàn)9.4.34×4鍵盤編碼器設(shè)計(jì)(1)列掃描計(jì)數(shù)器moduleCNT4A(CLK,EN,Q)inputCLK,EN;output[1:0]Q;reg[1:0]Q;always@(posedgeCLK)beginif(EN)beginQ<=Q+2'b01;endend endmodule(2)2—4譯碼器moduleDECODER(Y,A);input[1:0]A;output[3:0]Y;reg[3:0]Y;always@(A)begincase(A)2'd0:Y=4'b1110;2'd1:Y=4'b1101;2'd2:Y=4'b1011;2'd3:Y=4'b0111;e
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