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實(shí)驗(yàn)項(xiàng)目七RS觸發(fā)器和JK觸發(fā)器 4學(xué)時(shí)信息管理學(xué)院4306機(jī)房 實(shí)驗(yàn)簡(jiǎn)介 實(shí)驗(yàn)類型 設(shè)計(jì)性實(shí)驗(yàn)設(shè)備 PC機(jī) Multisim軟件 實(shí)驗(yàn)?zāi)康?掌握RS觸發(fā)器特性和設(shè)計(jì)方法 掌握J(rèn)K觸發(fā)器特性和設(shè)計(jì)方法 實(shí)驗(yàn)要求 上機(jī)前要作好充分準(zhǔn)備 預(yù)習(xí)實(shí)驗(yàn) 復(fù)習(xí)電子電路基礎(chǔ)知識(shí) 實(shí)驗(yàn)完成后 寫出詳細(xì)實(shí)驗(yàn)報(bào)告 實(shí)驗(yàn)環(huán)境 實(shí)驗(yàn)一至實(shí)驗(yàn)八使用Multisim10軟件 實(shí)驗(yàn)內(nèi)容和步驟 一 創(chuàng)建RS觸發(fā)器電路在元 器 件庫(kù)中單擊TTL 再單擊74系列 選取與非門74LS00N 在元 器 件庫(kù)中單擊Basic 基本元 器 件 然后單擊SWITCH 再單擊SPDT 選取兩個(gè)開關(guān)J1 J2 在元 器 件庫(kù)中單擊Sources 信號(hào)源 取一個(gè)電源V1和地 電源V1設(shè)置為5V 雙擊開關(guān)J2圖標(biāo) 打開SWITCH對(duì)話框 在對(duì)話框Value頁(yè)中的KeyforSwitch欄下拉菜單中選擇字母符號(hào)A 則 Key A 在元 器 件庫(kù)中單擊指示器件 選探測(cè)器來(lái)顯示數(shù)據(jù) 實(shí)驗(yàn)內(nèi)容和步驟 二 觀測(cè)輸出通過(guò)兩個(gè)開關(guān)改變輸入數(shù)據(jù) 按對(duì)應(yīng)的開關(guān)的開關(guān)鍵符號(hào) 即可改變開關(guān)位置 從而改變輸入數(shù)據(jù) 電源V1和地分別表示數(shù)據(jù)1和0 探測(cè)器亮表示數(shù)據(jù)為 1 探測(cè)器滅表示數(shù)據(jù)為 0 當(dāng)觸發(fā)器的輸入R 0 S 1時(shí) 觸發(fā)器的輸出Q 0 1 只要不改變開關(guān)J6 J7的狀態(tài) RS觸發(fā)器的輸出和Q將保持不變 取其他輸入數(shù)據(jù) 即可列出RS觸發(fā)器真值表 實(shí)驗(yàn)內(nèi)容和步驟 三 創(chuàng)建JK觸發(fā)器電路在元 器 件庫(kù)中單擊TTL 再單擊74系列 選中JK觸發(fā)器7473N 在元 器 件庫(kù)中單擊Sources 信號(hào)源 選中方波發(fā)生器V2 電源V1和地 如圖7 3 方波發(fā)生器V2設(shè)置電壓為5V 頻率1kHz Multisim有手動(dòng)和自動(dòng)兩種連線方式 電源V1設(shè)置電壓為5V 在元器件庫(kù)中單擊Basic 基本元器件 然后單擊SWITCH 再單擊SPDT 選取開關(guān)J1 J2和J3 為了便于控制 選擇不同字母符號(hào)或者數(shù)字符號(hào)來(lái)表示對(duì)應(yīng)的開關(guān)的開關(guān)鍵 J1用空格鍵控制 J2用A鍵控制 J3用B鍵控制 在儀器庫(kù)中選取邏輯分析儀 JK觸發(fā)器的輸入端1J 1K 清零端1CLR分別由開關(guān)J1 J2 J3控制 CLR是清零端 低電平時(shí)清零 時(shí)鐘1CLK由信號(hào)源方波發(fā)生器V2提供 為了便于觀察 可將時(shí)鐘信號(hào)1CLK JK觸發(fā)器輸出信號(hào)Q和分別接邏輯分析儀的管腳1 2 3 實(shí)驗(yàn)內(nèi)容和步驟 四 觀測(cè)輸出通過(guò)三個(gè)開關(guān)改變輸入數(shù)據(jù) 按對(duì)應(yīng)開關(guān)的開關(guān)鍵符號(hào) 即可改變開關(guān)位置 從而改變輸入數(shù)據(jù) 電源V1和地分別表示數(shù)據(jù)1和0 1 改變開關(guān)J3 使1CLR 0 觀測(cè)清零 可見輸出Q清零 2 清零端1CLR 1 改變開關(guān)J1 J2 使J K 0 可見輸出Q保持原態(tài) 3 清零端ICLR 1 改變開關(guān)J1 J2 使J 0 K 1 可見輸出Q置0 4 清零端1CLR 1 改變開關(guān)J1 J2 使J 1 K 0 可見輸出Q置1 實(shí)驗(yàn)

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