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文檔簡介
1、東北大學(xué)20春數(shù)字信號處理器原理及應(yīng)用在線平時作業(yè)2答案當(dāng)XPLLDIS為()時,系統(tǒng)直接采用外部時鐘或外部晶振直接作為系統(tǒng)時鐘。A.高電平B.低電平C.高阻D. 懸空此C281x CPU除了支持()個CPU級的中斷外,還有一個中斷擴(kuò)展控制器來仲裁外設(shè)中斷。A.64B.16C.32D.8DSP內(nèi)核它包括處理器內(nèi)核,指令緩沖器,數(shù)據(jù)存儲器和程序存儲器,I/O接口控制器,程序地址總線和程序數(shù)據(jù)總線,直接讀取的地址總線和數(shù)據(jù)總線等單元,其中最核心的是()。A.處理器內(nèi)核B.指令緩沖器C.數(shù)據(jù)存儲器和程序存儲器D.程序地址總線和程序數(shù)據(jù)總線世界上首枚DSP芯片采用工藝是()。A.CMOSB.PMOSC
2、.NMOSD.MOS在F2810和F2812處理器中,除了NMI和RESET其余12個可屏蔽中斷連接在()。A.時鐘模塊B.時鐘模塊C.事件管理器模塊D. CAN總線模塊為避免產(chǎn)生短通狀態(tài)可以采用兩種方法:調(diào)整功率管或者()。A.調(diào)整PWM控制信號B.調(diào)整CPU頻率C.調(diào)整通信速率D.調(diào)整系統(tǒng)時間看門狗計數(shù)器最大計數(shù)值是()。A.256B.254C.255D.257在地址位多處理器協(xié)議中(ADDR/IDLE MODE位為1),最后一個數(shù)據(jù)位后有一個附加位,稱之為()。A.標(biāo)識符B.校驗(yàn)位C.仲裁位D.地址位FET開關(guān)管在狀態(tài)切換過程中()。A.閉合快于開啟B.開啟快于閉合C.開啟閉合一樣快D.
3、開啟慢于閉合光電編碼器,是一種通過光電轉(zhuǎn)換將輸出軸上的機(jī)械幾何位移量轉(zhuǎn)換成()的傳感器。A.模擬量B.脈沖或數(shù)字量C.通信數(shù)據(jù)D.輸入數(shù)據(jù)PWM的定長周期稱之為PWM載波周期,它的倒數(shù)稱為PWM載波頻率。()A.錯誤B.正確F2812處理器提供兩個SCI接口,為可以獨(dú)立的操作實(shí)現(xiàn)半雙工通信,或者同時操作實(shí)現(xiàn)全雙工通信。()A.錯誤B.正確軟件改變系統(tǒng)工作頻率時,可以立即生效,無需等待。()A.錯誤B.正確定時器的時鐘源可以取自外部輸入信號(TCLKIN),QEP單元,內(nèi)部時鐘或者看門狗時鐘。()A.錯誤B.正確雖然應(yīng)用于不同領(lǐng)域的DSP有不同的型號但其內(nèi)部結(jié)構(gòu)大同小異,都具有哈佛 (Harva
4、rd)結(jié)構(gòu)的特征。()A.錯誤B.正確PWM數(shù)字脈沖輸出可以用來表征模擬信號,在PWM輸出端進(jìn)行微分可以得到期望的模擬信號。()A.錯誤B.正確由于CAN總線是一種串行通信協(xié)議,具有較高的通信速率、較強(qiáng)的抗干擾能力。()A.錯誤B.正確INTM作為全局中斷使能控制位,當(dāng)該位等于1 時全局中斷使能,當(dāng)該位等于0 時禁止所有中斷。()A.錯誤B.正確系統(tǒng)在上電復(fù)位時,SPI工作在標(biāo)準(zhǔn)SPI模式,禁止FIFO功能。()A.錯誤B.正確外設(shè)產(chǎn)生中斷時,中斷標(biāo)志寄存器(IF)相應(yīng)的位將被置0,如果中斷使能寄存器(IE)中相應(yīng)的使能位也被清零,則外設(shè)產(chǎn)生的中斷將向PIE控制器發(fā)出中斷申請。()A.錯誤B.正確 參考答案:B參考答案:B參考答案:A參考答案:C參考答案:A參考答案:A參考答案:C參考答案:D參考答案:B
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