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一、緒 (一)系統(tǒng)設(shè)計(jì)任 (二)設(shè)計(jì)思 二、硬件設(shè) (一)轉(zhuǎn)換電路設(shè) (二)真值有效值轉(zhuǎn)換電路設(shè) (三)555定時(shí)器矩形波轉(zhuǎn)換電路設(shè) 三、軟件設(shè) (一)A/D轉(zhuǎn)換、相位差程 (二 (三)標(biāo) 四、系統(tǒng)調(diào)試及誤差分 (一)標(biāo) (二)標(biāo) 標(biāo) 標(biāo) 五、結(jié) 致 參考文 附錄A:完整電路圖(沒(méi)有可不寫(xiě) 附錄B:程序(沒(méi)有可不寫(xiě) 。(一)。(二)。標(biāo)。標(biāo)。(三),…1.1

1.1,…1.1t1.1。(一)。(二)。(三)。。(一)。(二)。(三)。。(一)。(二)。標(biāo)。標(biāo)。最終的精度。有效值測(cè)量集成電路視其測(cè)量范圍和精度有多種規(guī)格可選,較通用的有ogAD536、AD636、AD736AD737AD7363-3所示。該器件是按有效值隱含運(yùn)算而設(shè)計(jì),能計(jì)算任意復(fù)雜波0.3%51T2T1T2T VRMS

這里,VRMS為信號(hào)的有效值,TV(t)是一個(gè)時(shí)間的函數(shù),但不一定是周期

1T[V2

0T0TAvg[V2(t)]1T[V2

T 等式兩邊除以VRMS

Avg[V2

VRMS

這個(gè)表達(dá)式就是測(cè)量一個(gè)信號(hào)真實(shí)有效值的基礎(chǔ)。AD736CC10~20uF;CF為輸出端濾波電容一般取10uF;CAV為平均電容,它是AD736的關(guān)鍵元件,用于進(jìn)行平均值運(yùn)算。其大小將33uF。。。AD1674帶有內(nèi)部采樣保持的完全12位逐次近(SAR)型模/數(shù)轉(zhuǎn)換器1/2LBS(INL)12內(nèi)有+10V5V,10V,0~10V8/12內(nèi)部帶有防靜電保護(hù)裝置12/8812CE:操作使能端;輸入為高時(shí),開(kāi)始進(jìn)行讀/轉(zhuǎn)換操作A0:位尋址/短周期轉(zhuǎn)換選擇輸入端。在轉(zhuǎn)換開(kāi)始時(shí),若A0為低,則進(jìn)行12位數(shù)據(jù)轉(zhuǎn)換;A0為高,則進(jìn)行周期更短的8位數(shù)據(jù)轉(zhuǎn)換;當(dāng)R/C=112/8=0時(shí),若A0為低,則在高8位(DB4~DB11)作數(shù)據(jù)輸出;若A0為高,則在DB0~DB3DB8~DB11作數(shù)據(jù)DB4~DB7置零。410VIN:10V0V~10V單極輸入或±5V20VIN:20V0V~20V單極輸入或±10VREFIN10V50?電阻后連于此端;REFOUT:+10V基準(zhǔn)電壓輸出端;BIPOFF50?REFOUT端相連;在單極輸入時(shí)接模擬地。VCC:+12V/+15V模擬供電輸入;VEE:-12V/-15V模擬供電輸入;VLOGIC:+5V邏輯供電輸入;陳家祺.運(yùn)動(dòng)圖像處理在車型識(shí)別中的應(yīng)用[J].汽車工程,1998,20(6):陳家祺.C程序設(shè)計(jì)[M].:新華ShihangS.Fuzzyself-organizingcontrolleranditsapplicationfordynamicprocesses[J].FuzzySetsandSystems,1998,26:151~164KaareChristian.BorlandC++Techniques&Utilitis[M].Ziff-(沒(méi)有可不寫(xiě)A加圖1.11.1B程#defineuintunsignedint#defineucharunsignedchar#defineADCSTU0x6cff#defineADCH0x6eff#defineADCL0x6fff#defineLEDoprtalP1sbitSTS=P3^4;sbitclk_key=P2^2;sbitu_i=P2^3;unitvolk,amps;unitphase;floatpower_fact;unittime_1=0;unittime_s=0;bittiming=0;uchar*p;ucharucharvoidint0_isr(void)interrupt{if}}}void}voiddelay(unit{ucharj=100;}uint{uint}void{ucharnum=0;}voidd

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