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VLSIFPGA設(shè)計(jì)平臺(tái)上設(shè)計(jì)硬件電路，實(shí)現(xiàn)數(shù)字圖像的空域?yàn)V波算法。位置，與圖像中灰度值為S0的點(diǎn)重合，模板的輸出響應(yīng)R為：R=K0*S0+K1*S1+…+K8*S8實(shí)現(xiàn)空域?yàn)V波算法可采用3個(gè)三階的FIR濾波器+延時(shí)單元來(lái)描述。3FIR吐率。為解決這些實(shí)際的FPGA設(shè)計(jì)中的關(guān)鍵問(wèn)題，在具體設(shè)計(jì)電路時(shí)，主要從構(gòu)，以及FIR濾波器的數(shù)據(jù)廣播結(jié)構(gòu)。y(n)=ax(n)+bx(n-1)+cx(n-2)線技術(shù)可以縮短關(guān)鍵路徑，如圖3所示。加法器，反之亦然。數(shù)據(jù)廣播結(jié)構(gòu)的FIR數(shù)字濾波器如圖4所示。到很高的通過(guò)率。這就是FIR濾波器數(shù)據(jù)廣播結(jié)構(gòu)的優(yōu)點(diǎn)。4-BOOTHWallaceTree3WallaceTree各個(gè)部分積中具有相同權(quán)重的數(shù)據(jù)位相加合并。通常采用全加器(FullAdder)23：2分積的數(shù)目很多時(shí)，采用WallaceTree乘法器來(lái)縮減部分和速度很快。2節(jié)介紹了本文中在FPGA數(shù)字濾波器FIR8b的灰度圖像，設(shè)計(jì)軟件是XILINX公司的ISE集成綜合開(kāi)發(fā)環(huán)境，仿真工具M(jìn)odelsimSE5.8b，綜合工具是ISE自帶的綜合軟件XST，實(shí)現(xiàn)芯片是XILINX公司的XC2V10

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