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文檔簡介

可編程邏輯器件

大作業(yè)（二）2012年12月、題目利用VerilogHDL設計一個電路，對輸入的一串二進制數，用于檢測序列中連續(xù)3個或者3個以上的1，狀態(tài)轉換圖如圖所示。要求：1、編寫源程序；2、給出仿真電路圖、狀態(tài)轉換圖和仿真波形圖程序代碼modulemoore(clk,din,op,reset);inputclk,din,reset;outputop;reg[1:0]current_state,next_state;regop;parameterS0=2'b00,S1=2'b01,S2=2'b10,S3=2'b11;always@(posedgeclk)beginif(!reset)current_state=S0;elsecurrent_state<=next_state;endalways@(dinorcurrent_state)next_statenext_state=S0;begincase(current_state)beginop=0;if(din==0)next_state=S0;elsenext_state=S1;endbeginop=0;if(din==0)next_state=S0;elsenext_state=S2;endbeginop=0;if(din==0)next_state=S0;elsenext_state=S3;endbeginop=1;if(din==0)elsenext_state=S3;enddefault:beginnext_state=S0;op=0;endendcaseendendmodule三、仿真波形圖可知仿真波形圖與狀態(tài)轉換圖的相符四、仿真電路圖din| >―~resetl >――clk| > 五、狀態(tài)轉換圖飛六、心得體會current_statedinreset S3 1 0PIclk通過設計過程對狀態(tài)機的概念有了更深的理解，認識到了其在現實生活中的重要應用。更熟練地掌握了Veri

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