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自覺遵守考場紀律如考試作弊此答卷無效密自覺遵守考場紀律如考試作弊此答卷無效密封線第1頁,共3頁南京工業(yè)大學
《數(shù)字邏輯設計》2021-2022學年期末試卷院(系)_______班級_______學號_______姓名_______題號一二三總分得分一、單選題(本大題共20個小題,每小題2分,共40分.在每小題給出的四個選項中,只有一項是符合題目要求的.)1、數(shù)字邏輯中的計數(shù)器可以按照不同的進制進行計數(shù)。一個六進制計數(shù)器,需要幾個觸發(fā)器來實現(xiàn)?A.三個。B.四個。C.不確定。D.根據(jù)計數(shù)器的類型判斷。2、在數(shù)字邏輯電路中,數(shù)據(jù)選擇器可以根據(jù)多個控制信號選擇不同的輸入數(shù)據(jù)。一個16選1數(shù)據(jù)選擇器,需要多少個控制信號?A.4個。B.5個。C.不確定。D.根據(jù)數(shù)據(jù)選擇器的類型判斷。3、對于一個由D觸發(fā)器構成的計數(shù)器,若要實現(xiàn)模5計數(shù),至少需要幾個D觸發(fā)器?A.2B.3C.4D.54、在數(shù)字邏輯設計中,如何用邏輯門實現(xiàn)一個6輸入的或門?A.可以用多個或門級聯(lián)實現(xiàn)。B.可以用與門和非門組合實現(xiàn)。C.不確定。D.或門不能用其他邏輯門5、在數(shù)字邏輯電路中,若要實現(xiàn)一個能對兩個4位二進制數(shù)進行相加并產(chǎn)生進位輸出的加法器,以下哪種集成電路芯片可能是最合適的選擇?A.74LS85B.74LS138C.74LS151D.74LS1616、在數(shù)字電路中,能夠?qū)⑤斎氲奶囟ùa轉換為相應的輸出信號以控制外部設備的電路是?A.編碼器B.譯碼器C.數(shù)據(jù)分配器D.控制器7、數(shù)字邏輯中的全加器可以實現(xiàn)兩個二進制數(shù)和一個進位的相加。一個全加器的輸入為A=1,B=1,進位C_in=1,那么輸出的和S和進位C_out分別是多少?A.S=1,C_out=1。B.S=0,C_out=1。C.不確定。D.根據(jù)其他因素判斷。8、若一個邏輯函數(shù)的最簡與或表達式為F=A+B'C,則其對偶式為?A.F'=(A'+B)C'B.F'=A'(B+C')C.F'=(A'+B')CD.F'=A(B'+C)9、用卡諾圖化簡邏輯函數(shù)F(A,B,C,D)=∑m(1,3,5,7,9,11,13,15),結果為?A.1B.0C.A+BD.A'B'10、對于一個異步時序邏輯電路,若輸入信號發(fā)生變化,輸出狀態(tài):A.立即改變B.在下一個時鐘脈沖到來時改變C.經(jīng)過一定的延遲后改變D.不確定11、在數(shù)字邏輯中,若要將一個4位的二進制數(shù)擴展為8位,應該在高位補多少?A.0B.1C.原數(shù)的最高位D.隨機值12、在數(shù)字電路中,能夠?qū)崿F(xiàn)“或非”邏輯運算的門電路是?A.或門B.與門C.或非門D.與非門13、對于一個由多個D觸發(fā)器構成的移位寄存器,若要實現(xiàn)串行輸入并行輸出,需要幾個時鐘脈沖?A.與觸發(fā)器個數(shù)相同B.觸發(fā)器個數(shù)的一半C.1D.不確定14、對于一個采用上升沿觸發(fā)的D觸發(fā)器,若在時鐘上升沿到來之前,D輸入端的值發(fā)生變化,那么觸發(fā)器的輸出會受到影響嗎?A.會B.不會C.取決于變化的時間D.以上都不對15、在數(shù)字邏輯中,若要對一個8位的二進制數(shù)進行奇偶校驗,校驗位應設置在:A.最高位B.最低位C.次高位D.次低位16、在數(shù)字邏輯電路中,譯碼器的輸出可以連接到其他邏輯電路。一個3線-8線譯碼器的輸出連接到一個與門的輸入,當譯碼器的輸入為特定值時,與門的輸出會怎樣?A.與門的輸出會根據(jù)譯碼器的輸出和與門的另一個輸入確定。B.與門的輸出會始終為高電平。C.不確定。D.與門的輸出會始終為低電平。17、對于一個8位的串行加法器,完成一次加法運算所需的時間是并行加法器的:A.8倍B.1/8C.2倍D.1/218、若要設計一個能對60進制進行計數(shù)的計數(shù)器,至少需要多少個觸發(fā)器?A.6B.7C.8D.919、在數(shù)字邏輯中,已知一個邏輯函數(shù)的真值表,如何用最小項之和的形式表示該函數(shù)?A.直接列出B.通過化簡C.無法表示D.以上都不對20、對于一個由與非門組成的基本邏輯電路,已知輸入信號A=1,B=0,C=1,那么經(jīng)過邏輯運算后的輸出結果是多少?A.0B.1C.不確定D.以上都不對二、簡答題(本大題共4個小題,共40分)1、(本題10分)詳細說明數(shù)字邏輯中數(shù)據(jù)選擇器和數(shù)據(jù)分配器的可測試性設計,包括測試向量生成和故障覆蓋率評估。2、(本題10分)闡述數(shù)字邏輯中計數(shù)器的計數(shù)范圍擴展和多位計數(shù)的實現(xiàn)方式,舉例說明在大規(guī)模計數(shù)應用中的方法。3、(本題10分)詳細說明在多路選擇器的級聯(lián)應用中,如何實現(xiàn)更多輸入數(shù)據(jù)的選擇。4、(本題10分)在數(shù)字電路設計中,解釋如何進行數(shù)字邏輯電路的故障診斷和測試,包括常見的測試方法和故障類型。三、設計題(本大題共2個小題,共20分)1、(本題10分)設計一個組合邏輯電路,實現(xiàn)對輸入的8位二進制數(shù)進行按位與
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