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文檔簡介

1、12.7 計數(shù)器、譯碼器、數(shù)碼管驅(qū)動顯示電路,該電路由計數(shù)器、譯碼器及數(shù)碼管驅(qū)動顯示電路組成，原理電路如圖12.7.1所示。計數(shù)器選用74LS191四位二進制同步可逆計數(shù)器，有四個J、K觸發(fā)器和若干門電路組成，有一個時鐘輸入（CLK）正邊沿觸發(fā)，四個觸發(fā)器同時翻轉(zhuǎn)的高速同步計數(shù)器。,由輸出端QB和QD經(jīng)邏輯組合電路接至計數(shù)器（LOAD）端，構(gòu)建計數(shù)進位阻塞電路。在設(shè)計時可根據(jù)需要，由相應的輸出端構(gòu)建組合邏輯電路，從而實現(xiàn)不同進制的計數(shù)器。,圖12.7.1 計數(shù)器、譯碼器、數(shù)碼管驅(qū)動顯示電路,從虛擬儀器中取邏輯分析儀XLA1，其上有1F共16個輸入端，14端分別于計數(shù)器的四個數(shù)據(jù)輸出端QAQD相

2、連，第511端 分別與數(shù)碼管的七段AG相連，第12端接CLK脈沖輸入端。用鼠標雙擊邏輯分析儀，將出現(xiàn)邏輯分析儀面板窗口如圖12.7.2所示。,圖12.7.2 時鐘脈沖、輸入、輸出波形時序關(guān)系圖,改變邏輯分析儀Clock區(qū)(Clock/Div)的個數(shù)，從“1”調(diào)到“32”。在圖12.7.2的左側(cè)顯示的號碼為原理圖的節(jié)點號碼，其并不能表示出計數(shù)器輸出端和數(shù)碼管的段位字母，顯示不用鼠標左鍵雙擊與邏輯分析儀“1”號輸入端連接的圖線，出現(xiàn)如圖12.7.3所示對話框。直觀，所以要對原理圖進行編輯。,將對話框中Node name改成與數(shù)碼管相對應的符號A。其他與邏輯分析儀的輸入端的連線都以此法行之，點擊仿真開關(guān)或按F5鍵進行仿真，計數(shù)器的輸出和數(shù)碼管的波形時序關(guān)系則立即直觀的被顯示在“Logic AnalyzerXLA1

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