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文檔簡介
數(shù)電五閻石五課后習題和答案x
【題5.1】畫出圖P5.1由與非門組成的SR鎖存器輸出端Q,Q’的電壓波形,輸入端,的電壓波形如圖中所示。
解:見圖A5.1.【題5.4】圖P5.4所示為一個防抖動輸出的開關(guān)電路。當撥動開關(guān)S時,由于開關(guān)觸點接通瞬間發(fā)生振顫,和的電壓波形如圖中所示,試畫出Q,Q’端對應的電壓波形。解:見圖A5.4.【題5.5】在圖P5.5電路中,若CLK,S,R的電壓波形如圖中所示,試畫出Q和Q’端與之對應的電壓波形。假定觸發(fā)器的初始狀態(tài)為Q=0.解:見圖A5.5.【題5.7】若主從結(jié)構(gòu)SR觸發(fā)器各輸入端的電壓波形如圖P5.7中所給出,試畫出Q,Q’端對應的電壓波形。設觸發(fā)器的初始狀態(tài)為Q=0.解:根據(jù)SR觸發(fā)器邏輯功能的定義和脈沖觸發(fā)方式的動作特點(主從結(jié)構(gòu)觸發(fā)器屬于脈沖觸發(fā)方式),即可畫出如圖A5.7所示的輸出電壓波形圖。
【題5.8】在脈沖觸發(fā)SR觸發(fā)器電路中,若S,R,CLK端的電壓波形如圖P5.8所示,試畫出Q,Q’端對應的電壓波形。假定觸發(fā)器的初始狀態(tài)為Q=0.解:根據(jù)SR觸發(fā)器邏輯功能的定義及脈沖觸發(fā)方式的動作特點,即可畫出圖A5.8中Q和Q’的電壓波形?!绢}5.9】若主從結(jié)構(gòu)SR觸發(fā)器的CLK,S,R,各輸入端電壓波形如圖P5.9所示,=1,試畫出Q,Q’端對應的電壓波形。解:根據(jù)SR觸發(fā)器邏輯功能的定義及脈沖觸發(fā)方式的動作特點,即可畫出Q,Q’的電壓波形,如圖A5.9所示。【題5.11】已知脈沖觸發(fā)JK觸發(fā)器輸入端J,K和CLK的電壓波形如圖P5.11所示,試畫出Q,Q’端對應的電壓波形。設觸發(fā)器的初始狀態(tài)為Q=0.解:根據(jù)JK觸發(fā)器邏輯功能的定義及脈沖觸發(fā)的動作特點,畫出的Q,Q’端電壓波形如圖A5.11。[題5.12]若主從結(jié)構(gòu)JK觸發(fā)器CLK,,,J,K端的電壓波形如圖P5.12所示,試畫出Q,Q’端對應的電壓波形。解:根據(jù)JK觸發(fā)器邏輯功能的定義及脈沖觸發(fā)方式的動作特點,畫出的Q,Q’端電壓波形如圖A5.12。【題5.14】已知維持阻塞結(jié)構(gòu)D觸發(fā)器各輸入端的電壓波形如圖P5.14所示,試畫出Q,Q’端對應的電壓波形。解:根據(jù)D觸發(fā)器邏輯功能的定義及維持阻塞結(jié)構(gòu)所具有的邊沿觸發(fā)方式,即可畫出Q和Q’的電壓波形如圖A5.14?!绢}5.15】已知CMOS邊沿觸發(fā)方式JK觸發(fā)器各輸入端的電壓波形如圖P5.15所示,試畫出Q,Q’端對應的電壓波形。解:根據(jù)JK觸發(fā)器邏輯功能的定義和邊沿觸發(fā)方式的動作特點,畫出的Q,Q’端電壓波形如圖A5.15。【題5.18】設圖P5.18中各觸發(fā)器的初始狀態(tài)皆為Q=0,試畫出在CLK信號連續(xù)作用下各觸發(fā)器輸出端的電壓波形解:根據(jù)每個觸發(fā)器的邏輯功能和觸發(fā)方式,畫出輸出端Q的電壓波形,如圖A5.18。
[題5.20]在圖P5.20電路中已知輸入信號的電壓波形如圖所示,試畫出與之對應的輸出電壓的波形。觸發(fā)器為維持阻塞結(jié)構(gòu),初始狀態(tài)為Q=0。(提示:應考慮觸發(fā)器和異或門的傳輸延遲時間。)
解:當=0,Q=0時,異或門的輸出等于0.變?yōu)楦唠娖揭院?,也變成高電平。因為也是觸發(fā)器的時鐘輸入端,所以經(jīng)過觸發(fā)器的延遲時間后,Q端被置為1狀態(tài);再經(jīng)過異或門的傳輸延遲時間,回到低電平。因此,高電平持續(xù)時間等于觸發(fā)器的傳輸延遲時間與異或門的傳輸延遲時間之和。
從高電平跳變成低電平以后電路的工作過程與上述過程類似。這樣就得到了圖A5.20的電壓波形?!绢}5.21】在圖P5.21所示的主從JK觸發(fā)器電路中,CLK和A的電壓波形如圖中所示,試畫出Q端對應的電壓波形。設觸發(fā)器的初始狀態(tài)為Q=0.
解:在CLK=1期間主從JK觸發(fā)器的主觸發(fā)器接收輸入信號。若此期間出現(xiàn)A=1的信號,則主從觸發(fā)器被置1,在CLK變?yōu)榈碗娖胶?,從觸發(fā)器隨之被置1,使輸出為Q=1.而當CLK回到高電平以后與非門的輸出變?yōu)榈碗娖?,于是又通過異步置0端R將觸發(fā)器置0.這樣我們就得到了圖
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