基于FPGA的10G以太網(wǎng)高速數(shù)據(jù)傳輸設(shè)計

基于FPGA的10G以太網(wǎng)高速數(shù)據(jù)傳輸設(shè)計1概述隨著人們對通信信息的充裕性、及時性和便捷性的要求越來越高，能夠隨時隨地、方便而及時地獲取所需信息，變得越來越重要。2002年，IEEE通過了10Gb/s速率的以太網(wǎng)標(biāo)準(zhǔn)——IEEE802.3ae[1]。10G以太網(wǎng)作為傳統(tǒng)以太網(wǎng)技術(shù)的一次較大的升級，在原有的千兆以太技術(shù)的基礎(chǔ)上將傳輸速率提高了10倍，以滿足人們對移動通信業(yè)務(wù)的要求。2009年1月國內(nèi)3G牌照正式發(fā)放，標(biāo)志著我國3G時代的到來。為了適應(yīng)移動通信的發(fā)展，各大運營商展開了大規(guī)模的3G移動通信網(wǎng)絡(luò)建設(shè)；而移動通信網(wǎng)絡(luò)建設(shè)的核心是基站建設(shè)，其成本也是最高的。此外，基站的性能好壞也是移動通信服務(wù)質(zhì)量的決定因素。所以，運營商在不斷尋求新的方式以提高通信服務(wù)質(zhì)量的同時，也在努力降低通信網(wǎng)絡(luò)建設(shè)的成本。分布式基站具有成本低、環(huán)境適應(yīng)性強、工程建設(shè)方便的優(yōu)勢，從而代表了下一代基站的的基本走向。分布式基站的核心是把傳統(tǒng)的宏基站基帶處理單元BBU和射頻拉遠(yuǎn)單元RRU分離，二者通過光纖連接。網(wǎng)絡(luò)部署時，BBU集中置放，其容量較大，實現(xiàn)了容量和覆蓋之間的轉(zhuǎn)換；RRU置于天面，其環(huán)境適應(yīng)性強，并且多個RRU可以共享BBU基帶資源，節(jié)省基帶投資。為了實現(xiàn)基站和直放站之間更有效的互通，愛立信、華為、NEC、北電網(wǎng)絡(luò)及西門子五大集團合力制定了CPRI接口協(xié)議。該接口的標(biāo)準(zhǔn)協(xié)議成為了一個公共的可用指標(biāo)之一。2CPRI協(xié)議簡述[2]CPRI（CommonPublicRadioInterface）協(xié)議定義了兩個協(xié)議層——物理層（L1）和數(shù)據(jù)鏈路層（L2）。CPRI接口是位于REC(RadioEquipmentContorl,無線設(shè)備控制)和RE(RadioEquipment，無線設(shè)備)之間以及兩個RE之間的內(nèi)部數(shù)據(jù)化接口；有3種不同的信息流（用戶平臺數(shù)據(jù)流SAPIQ、控制和管理平臺數(shù)據(jù)流SAPCM和同步平臺數(shù)據(jù)流SAPS）經(jīng)過CPRI接口傳輸。3FPGA實現(xiàn)CPRI協(xié)議傳輸方案3.1基本方案用FPGA實現(xiàn)CPRI協(xié)議傳輸具有以下2種方案。(1)方案一RocketIO收發(fā)器的FPGA來實現(xiàn)CPRI協(xié)議的光纖通信[3]。其中，RocketIO收發(fā)器是Xilinx公司在Virtex2Pro芯片及以上系列芯片上集成的專用串行通信模塊，在使用時不占用FPGA其他資源。在Virtex5系列FPGA中，RocketIO稱為GTP。該方案的優(yōu)點是電路板結(jié)構(gòu)緊湊，有利于PCB板布線，且具有很高的系統(tǒng)抗干擾能力。此外，參數(shù)設(shè)置方便，有利于系統(tǒng)調(diào)試。每塊Virtex5型的FPGA芯片中含有多個GTP收發(fā)器，可以通過運用4個GTP來實現(xiàn)10Gb/s的高速率傳輸。每一個GTP核中包含一個接收鏈路和一個發(fā)送鏈路[45]。(2)方案二利用串并轉(zhuǎn)換的專用芯片，如TI公司生產(chǎn)的TLK2501、美國國家半導(dǎo)體設(shè)計的串行/解串器SCAN25100[67]等。其中，SCAN25100的功能最完善，其具備8b/10b編解碼、高速串并轉(zhuǎn)換、鎖定檢測、CPRI信號和幀丟失檢測等功能。該芯片具有高精度延時校準(zhǔn)測量電路、時鐘管理以及信號調(diào)節(jié)功能。3.2具體實現(xiàn)SCAN25100支持的傳輸速率為2.4576Gb/s、1.2288Gb/s和0.6144Gb/s；TLK2501支持的傳輸速率為1.5～2.5Gb/s。如果采用專用串并轉(zhuǎn)換芯片，為了實現(xiàn)10Gb/s的速率，必須采用4塊專用芯片，從而加大了PCB板的布線難度和電路板面積，不利于電路設(shè)計。圖1以太網(wǎng)光接口結(jié)構(gòu)本文采取第一種設(shè)計方案完成10Gb/s的CPRI高速數(shù)據(jù)傳輸設(shè)計。如圖1所示，以太網(wǎng)光接口包括4部分：10GE光接口、PHY收發(fā)器、時鐘模塊、FPGA。其中，10GE光接口和PHY收發(fā)器是實現(xiàn)該10G以太網(wǎng)光接口的硬件設(shè)備；FPGA部分是本文設(shè)計的核心，采用Xilinx公司的Virtex6芯片。10GE光接口：光纖模塊，由光電子器件、功能電路和光接口等組成，其中包括發(fā)射和接收兩部分。發(fā)射部分是：輸入一定碼率的電信號，經(jīng)內(nèi)部的驅(qū)動芯片處理后驅(qū)動半導(dǎo)體激光器或發(fā)光二極管發(fā)射出相應(yīng)速率的調(diào)制光信號。接收部分是：一定碼率的光信號輸入模塊后由光信號管轉(zhuǎn)換為電信號，經(jīng)前置放大器后輸出相應(yīng)碼率的電信號[7]。根據(jù)參考文獻[7]討論的結(jié)果，本文設(shè)計的電路結(jié)構(gòu)選用的是XFP（萬兆以太網(wǎng)接口小封裝可插拔收發(fā)器）光模塊，與電路板的接口采用10Gb/s串行電路接口，其只負(fù)責(zé)完成光/電信號的轉(zhuǎn)換，優(yōu)點是體積小、功耗低且較易實現(xiàn)多端口集成。PHY收發(fā)器：物理層芯片，主要作用是提供以太網(wǎng)的接入通道。該模塊將從FPGA傳輸過來的4路3.125Gb/s的數(shù)據(jù)流合成12.5Gb/s的數(shù)據(jù)流傳輸給光模塊；并且，將從光模塊傳輸過來的12.5Gb/s的數(shù)據(jù)流分成4條鏈路，以3.125Gb/s傳輸給FPGA。在該數(shù)據(jù)流傳輸中，由于FPGA對數(shù)據(jù)進行8b/10b編解碼，因此有效碼率是10Gb/s，能夠滿足本文的設(shè)計要求，可以實現(xiàn)10G以太網(wǎng)的數(shù)據(jù)流傳輸。時鐘模塊：時鐘模塊內(nèi)采用輸出頻率為61.44MHz的有源晶振為系統(tǒng)提供時鐘。由于每一數(shù)據(jù)鏈路的數(shù)據(jù)傳輸速率為3.125Gb/s，GTP核對參考時鐘具有很高的精度要求，所以系統(tǒng)選擇高精度的差分時鐘作為參考時鐘。在該系統(tǒng)設(shè)計中，GTP核的參考時鐘沒有采用DCM（DigitalClockManager，數(shù)字時鐘管理器）提供的時鐘。因為在高速數(shù)據(jù)傳輸過程中，DCM會引入一些不可預(yù)測的時鐘抖動，這些抖動會隨著參考時鐘輸入到GTP核中，從而造成誤碼。通常使用外部差分晶振源，經(jīng)過全局時鐘緩沖的輸出信號作為GTP的參考時鐘，在數(shù)據(jù)傳輸過程中，由GTP內(nèi)部的DCM產(chǎn)生時鐘，作為RXUSRCLK、RXUSRCLK2、TXUSRCLK、TXUSRCLK2的時鐘源，從而消除時鐘抖動以及保持證數(shù)據(jù)傳輸過程中的同步性[89]。FPGA部分：其主要作用包括功能作用和配置監(jiān)控作用。在該方案中，F(xiàn)PGA的功能作用主要是完成數(shù)據(jù)的8b/10b編解碼、高速串并轉(zhuǎn)換，以及CPRI協(xié)議的成幀、解幀、同步、傳輸數(shù)據(jù)復(fù)/分解等操作。FPGA的