EDA技術智慧樹知到期末考試答案2024年

EDA技術智慧樹知到期末考試答案2024年EDA技術“LIBRARYIEEE;”表示該設計用到的庫是（

）庫。

A:VITALB:STDC:IEEED:WORK答案:IEEEFPGA結構中的PIC（ProgramI/OCell）的中文含義是（

）

A:可編程I/O單元B:可編程I/O細胞C:可編程I/O元件答案:可編程I/O單元

ASIC的中文含義是（

）

A:復雜可編程邏輯器件B:專用集成電路C:在系統(tǒng)可編程特性D:現(xiàn)場可編程門陣列答案:專用集成電路ASIC的英文全稱是（

）

A:FieldProgrammableGateArrayB:ElectronicDesignAutomationC:ComplexProgrammableLogicDeviceD:ApplicationSpecificIntegratedCircuits答案:ApplicationSpecificIntegratedCircuits“ComplexProgrammableLogicDevice”的中文含義是（

）

A:電子設計自動化B:現(xiàn)場可編程門陣列C:專用集成電路D:復雜可編程邏輯器件答案:復雜可編程邏輯器件CAE的中文含義是（

）

A:計算機輔助設計B:計算機輔助工程設計C:電子設計自動化答案:計算機輔助工程設計下列符號中表示與非的是（

）

A:XNORB:NORC:ABSD:NAND答案:NAND數(shù)據(jù)類型是標準邏輯位的選擇項是（

）

A:STD_LOGIC_1164B:LOGICC:STD_LOGIC_VECTORD:STD_LOGIC答案:STD_LOGICVHDL元件例化端口映射語句“U1:ND2PORTMAP(A1,B1,S1);”的端口映射關聯(lián)方式為（

）

A:結構關聯(lián)B:名字關聯(lián)C:混合關聯(lián)D:位置關聯(lián)答案:位置關聯(lián)語句含義為打開IEEE庫的語句是（

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A:LIBRARYIEEEB:USEIEEE.STD_LOGIC_1164.ALLC:USEIEEED:LIBRARY答案:LIBRARYIEEECAD的英文全稱是（

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A:ElectronicDesignAutomationB:ComputerAssistEngineeringDesignC:ComputerAssistDesign答案:ComputerAssistDesign語句“Y(0)<='1'WHENSR="000"ELSE'0';”是一個（

）

A:條件順序信號賦值語句B:條件執(zhí)行信號賦值語句C:條件并行信號賦值語句答案:條件并行信號賦值語句一個具有K根輸入線的LUT對應(

)bit的存儲器。

A:K2B:KC:2KD:2的K次方，即2k答案:2k語句“R16S(6DOWNTO0)<=R16S(7DOWNTO1);”含義為（

）

A:R16S(7DOWNTO1)的數(shù)據(jù)右移1位B:R16S(7DOWNTO1)的數(shù)據(jù)左移1位C:R16S(6DOWNTO0)的數(shù)據(jù)左移1位D:R16S(6DOWNTO0)的數(shù)據(jù)右移1位答案:R16S(7DOWNTO1)的數(shù)據(jù)右移1位最流行的第三方EDA工具有：仿真功能最強大的是（

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A:ModelSimB:ispLEVERC:QuartusⅡD:ISE/ISE-WebPACKSeriesE:Synplify答案:ModelSim數(shù)字時鐘管理器DCM主要包括的功能部分有（

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A:相位移位電路B:延遲鎖相環(huán)（DLL）C:狀態(tài)邏輯D:數(shù)字頻率同步器(DFS)答案:延遲鎖相環(huán)(DLL)###數(shù)字頻率同步器(DFS)###相位移位電路###狀態(tài)邏輯Xilinx公司現(xiàn)有的FPGA產(chǎn)品（

）

A:Spartan系列B:Cyclone系列C:Virtex系列D:XC系列答案:XC系列###Virtex系列###Spartan系列開展本科生研究性教學的必要性有（

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A:提高大學生專業(yè)創(chuàng)新能力的需要B:改變大學生被動學習學風的需要C:提高大學生實踐動手能力的需要D:提高大學生專業(yè)綜合素養(yǎng)的需要E:大眾化高等教育的差異化教育的需要答案:大眾化高等教育的差異化教育的需要###提高大學生實踐動手能力的需要###提高大學生專業(yè)創(chuàng)新能力的需要###提高大學生專業(yè)綜合素養(yǎng)的需要###改變大學生被動學習學風的需要Cyclone?Ⅲ器件平面結構的主要組成模塊包括（

）

A:嵌入式乘法器B:嵌入式存儲器塊C:I/O單元和PLLD:由邏輯陣列塊(LAB)答案:由邏輯陣列塊(LAB)###嵌入式存儲器塊###嵌入式乘法器###I/O單元和PLL邏輯宏單元(Macrocell)結構中的基本電路單元種類包括（

）

A:選擇器B:寄存器C:中央處理器D:門電路答案:門電路###選擇器###寄存器從應用和使用的角度講，EDA技術的基本內(nèi)容主要包括（

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A:硬件描述語言B:實驗開發(fā)系統(tǒng)C:軟件開發(fā)工具D:大規(guī)?？删幊踢壿嬈骷鸢?大規(guī)模可編程邏輯器件###硬件描述語言###軟件開發(fā)工具###實驗開發(fā)系統(tǒng)SOPC軟件設計開發(fā)的基本步驟包括（

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A:啟動設計工具NiosⅡIDEB:將程序下載到FLASH存儲器C:運行程序或調(diào)試程序D:建立新的源程序和軟件工程或?qū)胍呀ㄔ闯绦蚝蛙浖こ蘀:編譯工程答案:啟動設計工具NiosⅡIDE###建立新的源程序和軟件工程或?qū)胍呀ㄔ闯绦蚝蛙浖こ?##編譯工程###運行程序或調(diào)試程序###將程序下載到FLASH存儲器在FPGA的發(fā)展歷史上，出現(xiàn)過那些互連結構（

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A:層次化互聯(lián)結構B:孤島型互聯(lián)結構C:通道型互連結構答案:通道型互連結構###層次化互聯(lián)結構###孤島型互聯(lián)結構PROCESS語句結構的組成包括（

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A:順序描述語句部分B:敏感信號參數(shù)表C:進程說明部分D:并行描述語句部分答案:進程說明部分###順序描述語句部分###敏感信號參數(shù)表IEEE_1076標準程序包中定義的四種常用端口模式是（

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A:FIFO模式B:INOUT模式C:IN模式D:OUT模式E:BUFFER模式答案:IN模式###OUT模式###BUFFER模式###INOUT模式Quartus?Ⅱ的主要操作流程包括（

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A:工程仿真及分析B:編程下載及驗證C:工程實現(xiàn)的設置D:芯片的管腳鎖定E:文件及工程建立F:工程編譯及分析答案:文件及工程建立###工程實現(xiàn)的設置###工程編譯及分析###工程仿真及分析###芯片的管腳鎖定###編程下載及驗證通用EDA實驗開發(fā)系統(tǒng)，就是指能夠滿足各種EDA實驗或設計開發(fā)需要的EDA實驗開發(fā)系統(tǒng)。

A:對B:錯答案:對FPGA的英文全稱是FieldProgrammableGateArray。

A:對B:錯答案:對反熔絲結構有兩種：ONO反熔絲和M2M反熔絲。

A:對B:錯答案:對順序過程調(diào)用就是在順序語句的環(huán)境中執(zhí)行一個給定名字和參數(shù)的過程。（

）

A:對B:錯答案:對并行加法器通常比串行加法器占用更多的資源。

A:對B:錯答案:對信號的使用和定義范圍是實體、結構體和程序包。

A:錯B:對答案:對信號賦值目標<=賦值源；其中指向左邊的雙箭頭（<=）作為一個整體，稱之為信號賦值符號。

A:錯B:對答案:對ASIC設計的版圖設計（物理設計），就是是將邏輯設計中每一個邏輯元件、電阻、電容等以及它們之間的連線轉換成集成電路制造所需要的版圖信息。

A:錯B:對答案:對為了使更多的VHDL設計實體能被方便地訪問和共享，可以將我們已定義的常數(shù)、數(shù)據(jù)類型、元件調(diào)用說明以及子程序收集在一起，這就構成了VHDL程序包。

A:對B:錯答案:對VHDL規(guī)定，已列出敏感量的進程中不能使用任何形式的WAIT語句。

A:對B:錯答案:對功能仿真的結果與門級仿真器所做的功能仿真結果基本一致。

A:對B:錯答案:對使用Altera的QuartusⅡ軟件、SOPCbuilder/Qsys工具以及Nios?Ⅱ集成開發(fā)環(huán)境IDE/Eclipse，用戶可以輕松地將NiosⅡ處理器嵌入到FPGA系統(tǒng)，完成SOPC的硬件開發(fā)和軟件開發(fā)。

A:對B:錯答案:對一個文件夾下建立多個工程的方法是：從建第二個工程開始，當提示詢問是否選擇不同的工程目錄時，選擇“NO”,這時就可以在一個文件夾下建立多個工程。

A:錯B:對答案:對并行簡單信號賦值語句是VHDL并行語句結構的最基本的單元，它的語句格式如下：信號賦值目標<=表達式；

A:錯B:對答案:對EDA技術可廣泛應用于FPGA系統(tǒng)設計與開發(fā)、SOC/SOPC的設計開發(fā)、ASIC的前端設計等領域。

A:錯B:對答案:對對于QuartusⅡ10.0及其以上的高版本，除非安裝了特定的Modsim-Altera仿真工具，可直接使用設置波形的形式進行仿真外，否則只能通過調(diào)用第三方仿真軟件Modsim使用仿真測試程序的方式進行仿真。

A:對B:錯答案:對進行ASIC設計的系統(tǒng)規(guī)格說明，就是分析并確定整個系統(tǒng)的功能、性能、物理尺寸；確定制造工藝、設計周期和設計費用；建立系統(tǒng)行為模型，進行可行性驗證。

A:對B:錯答案:對在大規(guī)模和超大規(guī)模邏輯資源、低功耗與價格比值方面，CPLD比FPGA有更大的優(yōu)勢。

A:錯B:對答案:錯七段數(shù)碼管顯示器可分為共陽極、共陰極型兩種，其中共陰極型數(shù)碼管是指數(shù)碼管的7個發(fā)光二極管的陰極連接在一起，并且均接GND,而數(shù)碼管的驅(qū)動端a-g必須是高電平有效。

A:對B:錯答案:對從理論上說，無源憶阻器一旦替代SRAM存儲單元，能夠有效降低FPGA中晶體管的數(shù)量和功耗，提高器件的密度，同時兼有可重構性和非易失性。

A:錯B:對答案:對一般地，對相同的邏輯功能，CASE語句綜合后將耗用更多的硬件資源，但是有的邏輯用CASE語句無法描述，只能用IF語句來描述。

A:對B:錯答案:對在一般大規(guī)?？删幊踢壿嬈骷臄?shù)字系統(tǒng)設計中，只要使用IEEE庫中的STD_LOGIC_1164、STD_LOGIC_ARITH、STD_LOGIC_SIGNED和STD_LOGIC_UNSIGNED四個程序包就可以了。

A:對B:錯答案:對除非所有條件句中的選擇值能完整覆蓋CASE語句中表達式的取值，否則最末一個條件句中的選擇必須用“OTHERS”表示。

A:對B:錯答案:對目前我國典型的EDA實驗開發(fā)系統(tǒng)生產(chǎn)廠家有杭州康芯電子，友晶科技，依元素科技等廠家。

A:對B:錯答案:對動態(tài)掃描的原理是：通過一個掃描控制電路，對需要顯示的結果進行逐個掃描，使七段數(shù)碼管逐個進行顯示。只要每個管子掃描頻率超過人的眼睛視覺暫留頻率，就可以達到某一時刻點亮1個七段數(shù)碼管，卻能享有所有七段數(shù)碼管同時顯示的視覺效果，而且顯示也沒有閃爍抖動，從而間接實現(xiàn)顯示結果的同時顯示。

A:對B:錯答案:對利用結構描述方式，可采用結構化、模塊化設計思想，將一個大的設計劃分為許多小模塊，逐一設計調(diào)試完成，然后利用結構描述方法將它們組裝起來，形成更為復雜的設計。

A:對B:錯答案:對計數(shù)的控制在VHDL中可用一個進程表示，而計數(shù)的控制又包含正常計數(shù)（加1操作）和邊界處理（等于邊界則清零）兩種情況，而什么情況下進行計數(shù)或邊界處理，可使用IF條件語句進行判斷控制。

A:錯B:對答案:對CORDIC算法的實現(xiàn)有兩種結構方案：迭代結構和流水線結構。其中在流水線電路結構中，具有多個相同的單元電路，其中外部輸入XI、YI、ZI作為第一級流水線單元的輸入X(0)、Y(0)、Z(0)，中間各個單元首尾相接，也就是第N個單元的輸入與N-1個單元的輸出X(N-1),Y(N-1),Z(N-1)相連，第N個單元的輸出X(N),Y(N),Z(N)又與N+1個單元的輸入相連，而最后一級處理單元的輸出X(N)、Y(N)、Z(N)就是整個系統(tǒng)的輸出XO、YO、ZO。

A:對B:錯答案:對

答案:AI參考:很抱歉，您沒有提供具體的閱讀理解（選擇）/完型填空問題或文本，因此我無法為您提供準確的答案。如果您能提供更多信息，我將很樂意幫助您解答。'<imgsrc="/zhs/onlineexam/ueditor/201910/dc31a71b0193489789b7ee6f5935210a.png">

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