

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

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文檔簡(jiǎn)介
1、NiosII仿真簡(jiǎn)介與開發(fā)ARM等通常的處理器不同,NiosII的開發(fā)多了一個(gè)非常重要的手段:仿真。因?yàn)镹iosII畢竟還是基于FPGA的軟核處理器。在這里,我粗略得介紹一下nios的仿真;更加詳細(xì)的幫助信息請(qǐng)您參考Altera公司提供的文檔。如果本文能對(duì)您有一點(diǎn)點(diǎn)幫助,我都會(huì)感到非常高興。對(duì)于仿真,我主要講述一下在ModelSim6.0環(huán)境下的前仿真(niosII系統(tǒng)生成的時(shí)候,可以自動(dòng)生成仿真環(huán)境)。后仿真需要自己建立TestBench,比較繁瑣一點(diǎn),在此我就不再贅述了)。我只挑要點(diǎn)講一下,關(guān)于仿真的詳細(xì)指導(dǎo),請(qǐng)您參考官方提供的help文檔。1、準(zhǔn)備工作:在硬件調(diào)試(Debugashard
2、ware)前,有幾個(gè)準(zhǔn)備工作要做:1配置modelsim的路徑。在AlteraSOPCBuilder中,選擇File-SOPCBuilderSetup,檢察ModelsSimDirectory是否被正確得配置。如下圖:2生成niosII系統(tǒng)的時(shí)候,仿真環(huán)境被自動(dòng)生成。也就是在生成sopc系統(tǒng)的時(shí)候,Simulation.CreateModelSim(tm)projectfile被打勾選中。-upiionsjFunNios!IDE1*7HDL.Generate-systemmodulelogi&inVerilog.F7Simulation.CreateModefSm(trri)projectfi
3、les.3部分組件,比如JTAGUART,PIO,DRAM也有針對(duì)仿真選項(xiàng),請(qǐng)你正確得選擇!4如果您的系統(tǒng)比較復(fù)雜,需要專門生成針對(duì)simulation的代碼。也就是在ModelSimonly,nohardwaresupport前打勾。否則僅僅是系統(tǒng)初始化的過程,就讓人無法忍受,因?yàn)榉抡姹日5倪\(yùn)行要慢太多了。但如果系統(tǒng)簡(jiǎn)單,直接仿真在硬件上實(shí)際運(yùn)行的代碼也無妨(也就是無需在ModelSimonly,nohardwaresupport前打勾。)嶄Cleanexit(flushbuffers)I艮educeddevi匚巳dr.iyersSmallClibraryLinkwithprofiling
4、library彳險(xiǎn)d旦西條頑i如匹.hmid.寶更旦靈衛(wèi)口迅5。適當(dāng)?shù)眯薷拇a,使之合適于仿真。比如,我將i=0;while(iv50000)i+;修改為:i=0;while(i5)i+;否則,這個(gè)循環(huán)會(huì)花費(fèi)太多的仿真時(shí)間。6ModelSim6.0已經(jīng)被正確得安裝。如夠沒有搞定,請(qǐng)參考我以前寫的EDA軟件的安裝與配置。下面我們以調(diào)試在Nios無痛入門中生成系統(tǒng)為范例,介紹如何仿真nios處理器。1啟動(dòng)NiosIIIDE。2選中待仿真的C/C+Project3適當(dāng)?shù)眯薷拇a,使之與仿真相合適。需要將i=0;while(iBuildProject(Crtl+Shift+F3)選擇Run-RunAs
5、-3.NiosIIModelSim系統(tǒng)會(huì)自動(dòng)調(diào)用ModelSim6.0,進(jìn)入仿真環(huán)境。ijProjectQLibraryProject:-.SGpct+iiiluianuii.iiir-uuiimi口1iuupci心anil-it(awindowcontainingallsuchsignals.it(a|tagLuart_Odrive-displayinteractiveinputwindowforjt日qlu日rt_Dit回回tt(ah-printthig.mesagettit豳tt/tt/tt2Ztt/?tt/Ztt/井皿it/tt/Ztt/MoclelSim.SE6.0Aug192004
6、CopyrightMentorGraphics-CSrS-oration2004AllRightsReserv.ed.THISWORKCONTAINSTRADESECRETANDPROPRIETARYINFORMATIONWHICHIS-THEPROPERTYOFMENTORGRAPHICSCORPORATIONORITSLICENSORSANDISSUBJECTTOLICENSETERMS-.t+penFilensopcezC3Ae_SmallFI6_sim.mpfitLoadingprojectsdpcezC3Ae_SmailF1ModelSimiKNoContest7鍵入s,并回車4Lo
7、adingprojectopc_ezModelsimss是個(gè)宏命令,表示重新載入所有的HDL并編譯、仿真。如下是一些預(yù)定制的macro的含義:s-Loadalldesign(HDL)files.re-vlogandre-vsimthedesign.c-Re-compilememorycontents.BuildsC-andassembly-languageprograms(andassociatedsimulationdata-filessuchasUARTsimulationstrings)forrefreshingmemorycontents.DoesNOTre-generatehardw
8、are(HDL)filesONLYWORKSWITHLEGACYSDK(NottheNiosIDE)w-Sets-upwaveformsforthisdesignEachSOPC-Buildercomponentmayhavesignalsmarkedfordisplayduringsimulation.Thiscommandopensawave-windowcontainingallsuchsignals.l-Sets-uplistwaveformsforthisdesignEachSOPC-Buildercomponentmayhavesignalsmarkedforlistingduri
9、ngsimulation.Thiscommandopensalist-windowcontainingallsuchsignals.jtag_uart_O_drive-displayinteractiveinputwindowforjtag_uart_0#h-printthismessage8然后,選擇View-DebugWindows-Wave,打開WAVE窗口。目wave-defaultFileEditVievinsertFormatToolsWindow色E冒緒:丫寄1虱廉專鑑9在Object中,選中elk,然后點(diǎn)擊右鍵。在彈出來的對(duì)話框中,選擇AddtoWave-SelectedSin
10、als,添加elk信號(hào)到Wave窗口中。10如法炮制,添加你感興趣的信號(hào)到WAVE窗口中,比如,我添加了/test_bench/reset_n,/test_bench/out_port_from_the_led_pio等,如下圖:11然后鍵入run1ms并回車,系統(tǒng)就會(huì)開始仿真1ms,你可以鍵入你感興趣的仿真時(shí)間,比如2ms等等了。注意,不要鍵入太長(zhǎng)的仿真時(shí)間,不然會(huì)是很很漫長(zhǎng)的等待,因?yàn)榕c實(shí)際硬件想比較,仿真是很慢很慢很慢的。addwavesim:/tet_bench/UUJ/ths,.,onchiVSIM17run1mJ%12。仿真結(jié)束后,可以察看Wave窗口,可以看到led_pio的變化:0-0100-1000-0000-等等,呵呵,與硬件的變化完全一致。OK。仿真就先介紹到這兒!在FPGA設(shè)計(jì)、IC設(shè)計(jì)中,仿真
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