集成電路設(shè)計(jì)實(shí)踐

1、集成電路設(shè)計(jì)實(shí)踐報(bào)告一、設(shè)計(jì)任務(wù)（1）八選一數(shù)據(jù)選擇器 依據(jù)8選1數(shù)據(jù)選擇器的真值表，給出 八選一 MUX電路圖，完成由電路圖到晶體管級(jí)的轉(zhuǎn)化。（2）繪制原理圖（Sedit），完成電路特性模擬（Tspice，瞬態(tài)特 性），給出電路最大延時(shí)時(shí)間；（3）遵循設(shè)計(jì)規(guī)則完成晶體管級(jí)電路圖的版圖，流程如下：版圖布局規(guī)劃一基本單元繪制一功能塊的繪制一布線規(guī)劃-總體 版圖）；（4）版圖檢查與驗(yàn)證（DRC DRC DRC DRC檢查）；（5）針對(duì)自己畫(huà)的版圖，給出實(shí)現(xiàn)該電路的工藝流程圖。二、電路設(shè)計(jì)方案的確定數(shù)據(jù)選擇器是指根據(jù)給定的輸入地址代碼，從一組輸入信號(hào)中選 出指定的一個(gè)送至輸出端的組合邏輯電路。有時(shí)也

2、把它叫做多路 選擇器或多路調(diào)制器。八選一數(shù)據(jù)選擇器的功能表K2K3KQY00aDO001D1010D2二0=61-1-D300D4 1701 D5110D611-D7根據(jù)多路開(kāi)關(guān)的開(kāi)關(guān)狀態(tài)（地址碼）K2,K1,K0的狀態(tài)選擇D0-D7中某一個(gè)通道的數(shù)據(jù)輸送到輸出端Y.如上面功能表所示。電路圖設(shè)計(jì)如下:2.相較于第一種電路，第二種傳輸門(mén)電路管子少，設(shè)計(jì)簡(jiǎn)單，版圖 易于制作，且能較好的實(shí)現(xiàn)八選一數(shù)據(jù)選擇電路要求，故而選擇 該電路作為設(shè)計(jì)電路。三、電路特性及仿真用s-Edit軟件畫(huà)出選擇好的傳輸門(mén)電路，如下電路圖畫(huà)好之后，先檢查是否有錯(cuò)誤，如果沒(méi)有錯(cuò)誤，標(biāo)注好管子尺寸，然后再建立網(wǎng)表文件。.spEx

3、port NetlistWaveform ProLing OptionsM Enible waveform probingProbe II at a File Locati on|G：practi cet ：扣涅皿侶di t EIE 1即口 dul el. dat網(wǎng)表文件建立好之后，打開(kāi)wintsp軟件，然后打開(kāi)剛才建立的網(wǎng)表文件然后再添加上電源和輸入以及路徑。T-Spice Command Tool田，An &1、必二ff-Current sourceEl- Piles:- 11 k Library file=ii=Delete Library fil 主Ini tl -ill由.Outpu

4、tQ- Satti it gc 主J. Tab恥 Voltase source p- Optimi ra.ti imInsert Conmajid Cancel函 T-Spice - pviodulel .sp|7t i - rdit View Simulation Table Options Window Help si號(hào)店 褊m電的c 士 sg醪 . H | 餐A SPICE net list written, b* 3-Edit Wi-n32 T .03A Written on Jon 5, 2017 at 15; 5S; 4-0A Wavefoxrr. piabina GarnTban

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8、u A5-6p P3-2u E2 DT Gnd FTENH L-2u W-2 2u AD-6p FD-2u A5-645p P3-2u KO NTS &nd RENH L-2u W-22u AD-66p PD-24 AS-6p F3-24u N65 Gnd Gnd NEtlH L-2u W-22u AD-Stip PD-2 4u AS-66p P3-2uM21 N6 K2 Vdd Vdd PEMH L=2u W=22u AD=66p FD=2 4u AS=66p PS=2 4o M22 N69 N65 Vdd Vdd FENH L=2u W=22u AD=p PD=2 4u AS=6p PS=

9、2 4td M23 Y N-69 Vdd Vdd FENH ：L=2u W=22u AD=6-6p PE=2 4u A5=-66p PS=2 4u M2 4 N6S KO Vdd Vdd FENH L=2u W=22u AD=66p FD=2 4u AS=66p PS=2 4o End cf main circuit: ModuleO WDD Vdd Gnd 5VKOKOGNDPULSE (053ns0. InsO.ln50nslaons VK1KIGNDPULSE (053ns0. InsO.ln100ns200nsVK2K2GNDPULSE (053ns0. InsO.ln200ns00n

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11、s).tr己ri/cp 5n 160On stazt=0n itethod=bdf, print V(Y V(K0 V(K1 V(K2| V(D0 V(D1 V(D2 V(D3 V(D4) V(D5| V(D6 V(D7 .end添加完畢后開(kāi)始運(yùn)行。&j“ut 4?4u4l. 4miItpuE Eil Kijdvl EpJrpRin Eiaul止!皿亨Tiae fflCOj5 3DJKTitd.AdtdvaFudTtIkd4hH*idnlISrapJCE - 口*T HFICEfc L3.ehsBroiijcr Reltise IH T-Spici Bln24.154919CojJiEinc

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14、0Caupled口Ei 1項(xiàng)登= - 0Cuirent Murces - 0 TCC5 - 如網(wǎng)表文件運(yùn)行完之后，顯示出仿真波形圖如下:分析仿真所得出的波形曲線，對(duì)比八選一數(shù)據(jù)選擇器所需要實(shí)現(xiàn) 的功能，得出結(jié)論即該電路圖能夠?qū)崿F(xiàn)八選一數(shù)據(jù)選擇器的功能， 故，該電路圖設(shè)計(jì)符合實(shí)驗(yàn)要求。四、版圖的布局規(guī)劃及基本單元設(shè)計(jì)由所設(shè)計(jì)的電路圖可知，一個(gè)八選一數(shù)據(jù)選擇器需要14個(gè) nmos管和5個(gè)cmos管。由于管子數(shù)目較多，所以應(yīng)提前規(guī)劃好， 各個(gè)管子應(yīng)如何擺放，方便最后布線。特別需要注意的是，所有 光刻孔的幾何尺寸都必須大于或等于最小距離要求。設(shè)置規(guī)則:Setup Design RulesRiiLe：

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18、:.GKXT:.：:.:：:!HZ 19 12 20 1 NEHH L=35Dn M=1.5t& AD=1.425p PD=g9旦 A3=l 55p P5=5b1LL 片 ML DPilH GLTE SCCTRCE BULK (-221-45 S6.2 -2L9a95 S6-55|iM2 10 251 NENH L-350n M-1.AD-l,25p PD3 - 3u AS1.575：p P5-S B luGfiTE SCDRCE BULK (-232-75 77.55 -231-25 779卜 1 NENH L-2S0n W-l-Su AD-1.2p GATE SOURCE B-OTrK (

19、-229,3 77.55 1 NEKH L-35DnAB-1.425pGATE SOURCE BULK (-Z31-Q5 71,5 1 KENH L=35 Dn 網(wǎng)二l5ll JLD=1.42 5p GATE SOURCE BULK (-225 74.5 1 13ENH L=35 Dn N=1 511 AD=1 . 25：P* M2 DPilNM2 室 ISw M3 DRAIKH4 9 13 14： M1: DEUtlKt1.43Sp PD-4-勺口 Al.E7Ep -H13 聞mr GSuiE source bjik(-221.3 bi.2 -21?.e ai.55)Ml 4 16 23 2

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