基于A(yíng)DSP TS201的雷達(dá)信號(hào)處理機(jī)設(shè)計(jì)-設(shè)計(jì)應(yīng)用

精品文檔-下載后可編輯基于A(yíng)DSPTS201的雷達(dá)信號(hào)處理機(jī)設(shè)計(jì)-設(shè)計(jì)應(yīng)用摘要：開(kāi)發(fā)了一套以4片TS201和一片F(xiàn)PGA為的雷達(dá)信號(hào)處理系統(tǒng)。DSP僅通過(guò)鏈路口實(shí)現(xiàn)點(diǎn)對(duì)點(diǎn)通信，內(nèi)存空間獨(dú)立。系統(tǒng)僅用一副板卡即完成了雷達(dá)數(shù)據(jù)處理，使其具有硬件結(jié)構(gòu)簡(jiǎn)單、體積小、程序易調(diào)試、整體可靠性高等特點(diǎn)，可以實(shí)現(xiàn)副瓣對(duì)消、四路信號(hào)的脈沖壓縮與動(dòng)目標(biāo)檢測(cè)等功能，該系統(tǒng)已成功應(yīng)用于實(shí)際工程中。

現(xiàn)代雷達(dá)信號(hào)處理已成為雷達(dá)功能實(shí)現(xiàn)的關(guān)鍵，本文根據(jù)某型雷達(dá)信號(hào)處理機(jī)的系統(tǒng)需要，對(duì)其硬件結(jié)構(gòu)及軟件設(shè)計(jì)做了系統(tǒng)優(yōu)化。設(shè)計(jì)了1套以4片TS201和1片F(xiàn)PGA為信號(hào)處理板，該系統(tǒng)僅用l副板卡即實(shí)現(xiàn)空時(shí)二維信號(hào)處理。實(shí)現(xiàn)了自適應(yīng)副瓣相消，4路脈沖壓縮與MTI／MTD，副瓣匿影和差波束測(cè)角等算法，可以完成對(duì)目標(biāo)距離，方位偏差量的測(cè)算，滿(mǎn)足系統(tǒng)需求。

1系統(tǒng)組成分析

回波信號(hào)在天線(xiàn)上進(jìn)行部分微波合成，形成和、差通道信號(hào)及兩路輔助天線(xiàn)信號(hào)，進(jìn)行IQ正交插值，1／8抽取后，形成4路待測(cè)數(shù)據(jù)，數(shù)據(jù)率共為128MB／s。系統(tǒng)算法結(jié)構(gòu)，如圖1所示，主要由旁瓣相消模塊，數(shù)字脈壓模塊，MTD處理模塊由3部分組成。和路信號(hào)MTD(FFT-CFAR)后經(jīng)副瓣匿影若判定有目標(biāo)則再由和、差兩路數(shù)據(jù)計(jì)算方位偏差量。

以雷達(dá)工作的低重頻模式為例，IQ數(shù)據(jù)為5388點(diǎn)，重頻為140Hz，考慮到一定的時(shí)間余量，4路信號(hào)的傳輸及處理必須在6．7ms的時(shí)間內(nèi)完成。因此系統(tǒng)的數(shù)據(jù)速率、數(shù)據(jù)量及運(yùn)算規(guī)模決定了系統(tǒng)設(shè)計(jì)必須具有以下特點(diǎn)：

(1)具有高性能浮點(diǎn)處理芯片，可完成旁瓣相消、脈沖壓縮、相參積累、雜波圖、恒虛警處理。

(2)內(nèi)部各處理芯片間可進(jìn)行高速數(shù)據(jù)傳遞且可外部擴(kuò)展存儲(chǔ)芯片，保存大量數(shù)據(jù)。

(3)具備對(duì)外的數(shù)據(jù)接口和控制接口，并可輸出故障檢測(cè)信號(hào)。

(4)軟件設(shè)計(jì)中必須進(jìn)行大量?jī)?yōu)化，保證上述所有處理模塊在1個(gè)脈沖周期內(nèi)完成。

2雷達(dá)處理機(jī)實(shí)現(xiàn)

2．1硬件平臺(tái)設(shè)計(jì)

系統(tǒng)運(yùn)算量及時(shí)間要求，信號(hào)處理板需采用多DSP并行處理的結(jié)構(gòu)，為達(dá)到高速浮點(diǎn)處理能力、高數(shù)據(jù)吞吐率及大內(nèi)存空間的要求，DSP芯片選用ADSP-TS201，它是ADI公司型號(hào)的TigerSHARC架構(gòu)高性能浮點(diǎn)數(shù)字信號(hào)處理器。它具有達(dá)600MHz的工作時(shí)鐘，且每周期可完成4條指令；包括雙獨(dú)立運(yùn)算模塊及用于地址計(jì)算的雙獨(dú)立整型ALU，可完全并行操作；擁有24MB／s的片內(nèi)存儲(chǔ)器，內(nèi)存容量大；此外還有14路DMA控制器及外部端口、4個(gè)鏈路口，可進(jìn)行高速數(shù)據(jù)吞吐；擁有4個(gè)SDRAM控制器，可外部擴(kuò)展存儲(chǔ)芯片；擁有4個(gè)可編程flag引腳，可對(duì)外輸出所需標(biāo)志信號(hào)。

多DSP設(shè)計(jì)通常有共享總線(xiàn)方式和鏈路口耦合方式兩種結(jié)構(gòu)。共享總線(xiàn)結(jié)構(gòu)的優(yōu)點(diǎn)是可以提供全局地址空間，把多DSP的地址空間映射到主機(jī)的內(nèi)存空間進(jìn)行統(tǒng)一訪(fǎng)問(wèn)。任一DSP也可通過(guò)總線(xiàn)讀寫(xiě)其它處理器內(nèi)存，操作方便。然而，當(dāng)多DSP間數(shù)據(jù)交換頻繁時(shí)，總線(xiàn)競(jìng)爭(zhēng)往往造成數(shù)據(jù)通信的總線(xiàn)瓶頸，因而該方法有明顯的缺點(diǎn)。采用鏈路口耦合方式則具有明顯的優(yōu)點(diǎn)，各DSP總線(xiàn)獨(dú)立，擁有完全獨(dú)立的內(nèi)存空間，各DSP程序設(shè)計(jì)可完全獨(dú)立，減小了程序調(diào)試的難度。各DSP之間僅通過(guò)鏈路口無(wú)縫連接，片間連線(xiàn)少，降低了PCB布線(xiàn)難度和層數(shù)，節(jié)約了制板成本。此外，數(shù)據(jù)傳輸采用鏈路口的DMA方式并不占用DSP內(nèi)核的運(yùn)算時(shí)間，可以提高處理板的實(shí)時(shí)性能。因而采用將4片ADSP-TS201通過(guò)鏈路口兩兩互連，形成松耦合的多DSP結(jié)構(gòu)，如圖2所示。各DSP通過(guò)鏈路口可在任意兩個(gè)DSP之間進(jìn)行達(dá)500MB／s的數(shù)據(jù)傳輸。

板卡主要以4片TS201與1片F(xiàn)PGA為，外加Flash，SDRAM與光纖及其配置芯片協(xié)同完成數(shù)據(jù)存儲(chǔ)及傳輸。FPGA主要完成系統(tǒng)中與雷達(dá)匹配的時(shí)序控制，對(duì)板外的數(shù)據(jù)傳輸與對(duì)DSP的總線(xiàn)通信。FPGA通過(guò)兩套獨(dú)立的32位外部數(shù)據(jù)總線(xiàn)與DSP0和DSP1連接，采用流水協(xié)議，外部總線(xiàn)工作頻率為50MHz，可以實(shí)現(xiàn)400MB／s的數(shù)據(jù)傳輸速度，達(dá)到了系統(tǒng)可進(jìn)行高速數(shù)據(jù)傳輸?shù)囊?。系統(tǒng)時(shí)鐘為50MHz，TS201經(jīng)12倍頻工作在600MHz，單板卡的系統(tǒng)峰值處理能力可以達(dá)到14．4Gflops，板卡運(yùn)算速度滿(mǎn)足了系統(tǒng)需求。

2．2系統(tǒng)軟件設(shè)計(jì)及優(yōu)化

系統(tǒng)算法的復(fù)雜性與計(jì)算中的動(dòng)態(tài)范圍的要求，系統(tǒng)算法在DSP中軟件化設(shè)計(jì)，調(diào)試方便。回波經(jīng)微波合成后形成和、差路及兩路輔助通道信號(hào)，A／D采樣正交差值后形成4路數(shù)據(jù)經(jīng)光纖傳入FPGA，DSP0經(jīng)總線(xiàn)以DMA方式接收4路數(shù)據(jù)，并分發(fā)至其它3片DSP。各DSP單獨(dú)處理一路數(shù)據(jù)，如圖2所示，MTD后回傳至DSP1進(jìn)行副瓣匿影及門(mén)限檢測(cè)，并估算目標(biāo)方位偏差量，檢測(cè)結(jié)果由DSP1經(jīng)總線(xiàn)以DMA方式返還至FPGA，所有的模塊限制在1個(gè)脈沖周期內(nèi)完成，形成了圖3的軟件流程圖。

(1)數(shù)字脈沖壓縮。

系統(tǒng)中采用頻域方法實(shí)現(xiàn)脈沖壓縮。其基本原理是先對(duì)回波信號(hào)做FFT得其頻譜S(ω)，將S(ω)與匹配濾波器頻譜H(ω)頻域點(diǎn)乘，對(duì)乘積結(jié)果做IFFT即得脈壓結(jié)果Y(n)，整個(gè)過(guò)程由兩次FFT，一組頻域點(diǎn)乘，及IFFT運(yùn)算組成，由下式表示

Y(n)=IFFT{FFT[s(n)]*FFT[h(n)]}(1)

1)針對(duì)TS201芯片內(nèi)存量大的特點(diǎn)，將H(ω)直接存入DSP內(nèi)存，以H(ω)所需內(nèi)存換取了FFT執(zhí)行時(shí)間。2)脈沖壓縮結(jié)果是否乘以N對(duì)后續(xù)處理無(wú)實(shí)質(zhì)影響。故IFFT的實(shí)現(xiàn)省略了除以N的操作，在此基礎(chǔ)上DSP中可由兩種方法實(shí)現(xiàn)：一種是通過(guò)改變旋轉(zhuǎn)因子中正弦項(xiàng)的符號(hào)，調(diào)用FFT函數(shù)實(shí)現(xiàn)，運(yùn)算速度與FFT完全一致，但保存新的旋轉(zhuǎn)因子多耗費(fèi)了一倍內(nèi)存；另外一種則為實(shí)虛交換后做FFT，再實(shí)虛交換即實(shí)現(xiàn)IFF-T，該方法優(yōu)點(diǎn)是不占用新的內(nèi)存。這里在DSP程序中對(duì)第二種方法稍加改進(jìn)可使處理時(shí)間與FFT完全一致：在頻域點(diǎn)乘中結(jié)果輸出時(shí)完成次實(shí)虛反序不占用額外指令，稍后中可看出在MTD模塊中稍加改動(dòng)可使脈壓輸出的實(shí)虛順序并不引起系統(tǒng)指令的增加。原脈沖壓縮處理時(shí)間為：經(jīng)改進(jìn)后處理時(shí)間可縮短為。內(nèi)核時(shí)鐘工作在600MHz時(shí)，1024，4096，8192點(diǎn)的頻域脈壓時(shí)間42．24μs、272．63μs、632．1μs，遠(yuǎn)小于脈沖重復(fù)后期，保證了系統(tǒng)功能的實(shí)現(xiàn)。

(2)MTD模塊實(shí)現(xiàn)。

相參積累技術(shù)進(jìn)一步提高了系統(tǒng)信噪比，使雷達(dá)在各種雜波背景下的目標(biāo)檢測(cè)能力提高。MTD模塊用16點(diǎn)FFT實(shí)現(xiàn)，由于設(shè)計(jì)中脈沖壓縮輸出為先虛后實(shí)，故需對(duì)時(shí)域抽取的16點(diǎn)FFT級(jí)蝶形運(yùn)算稍作修改，使對(duì)保存+j寄存器的操作與對(duì)保存re寄存器的操作互換，執(zhí)行時(shí)間可與原16點(diǎn)FFT完全一致。

DSP1還需處理雜波圖，正常視頻檢測(cè)，測(cè)角等，內(nèi)存消耗大，因此占用部分SDRAM空間輔助存放了8周期的脈壓結(jié)果，數(shù)據(jù)傳輸量為5388×2×8=86208，數(shù)據(jù)量較大，因此MTD模塊的主要實(shí)現(xiàn)難點(diǎn)是數(shù)據(jù)傳輸時(shí)間問(wèn)題。

MTD是對(duì)同一距離單元上的脈壓數(shù)據(jù)進(jìn)行處理，因此要求在DMA傳輸?shù)倪^(guò)程中實(shí)現(xiàn)矩陣行列轉(zhuǎn)置，8個(gè)脈沖周期的數(shù)據(jù)量已經(jīng)超出了普通一維DMA傳輸方式的上限，且若在SDRAM中跳址傳輸，遭遇頻繁的跨頁(yè)尋址時(shí)會(huì)耗費(fèi)更多時(shí)間。采用二維DMA傳輸方式，通過(guò)改變TCB配置使DMA傳輸在SDRAM中連續(xù)尋址，而在DSP端接收地址自動(dòng)跳變，在矩陣傳輸?shù)耐瑫r(shí)實(shí)現(xiàn)行列轉(zhuǎn)置。系統(tǒng)時(shí)鐘為50MHz，傳輸時(shí)間為86208／50=1．73ms，DMA傳輸方式無(wú)需消耗內(nèi)核時(shí)鐘，占用總線(xiàn)時(shí)間僅為1．73ms，滿(mǎn)足了傳輸時(shí)間的要求。

經(jīng)MTD后和路信號(hào)經(jīng)副瓣匿影及門(mén)限檢測(cè)后判定有目標(biāo)，則差路信號(hào)在相同距離門(mén)上按濾波器號(hào)選取對(duì)應(yīng)多普勒通道的處理結(jié)果，按式(2)查找誤差曲線(xiàn)完成和差波束測(cè)角

式中，Y△為差路信號(hào)數(shù)據(jù)；Y∑為和路信號(hào)數(shù)據(jù)；k為一常數(shù)；ε為所求方位誤差角?；夭ǖ拿}壓結(jié)果，正常視頻輸出，MTD檢測(cè)結(jié)果，目標(biāo)方位角誤差角均按距離波門(mén)順序由FPGA返還至伺服系統(tǒng)，控制相控陣天線(xiàn)調(diào)整波束指向?qū)?zhǔn)目標(biāo)。

3結(jié)束語(yǔ)

本文以4片ADSP-TS201與1片F(xiàn)P