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文檔簡介
1、精品自學考試資料推薦全國 2018 年 4 月高等教育自學考試計算機組成原理試題課程代碼: 02318第一部分選擇題 (共 15 分 )一、單項選擇題(本大題共15 小題,每小題1 分,共 15 分 )在每小題列出的四個備選項中只有一個是符合題目要求的,請將其代碼填寫在題后的括號內。錯選、多選或未選均無分。1.若 X 補=0.1011,則真值 X=()A.0.1011B.0.0101C.1.1011D.1.01012.若十六進制數為 B5.4 ,則相應的十進制數為 ()A.176.5B.176.25C.181.25D.181.53.一個 n+1 位整數原碼的數值范圍是 ( )A. - 1n+1
2、x2 n- 1B.- 2 n+1x2 n- 1C.- 2 n+1x 2n- 1D.- 2 n+1 x 2 n- 14.若采用雙符號位補碼運算,運算結果的符號位為01,則 ( )A. 產生了負溢出 ( 下溢 )B.產生了正溢出 (上溢 )C.結果正確,為正數D.結果正確,為負數5.已知一個 8 位寄存器的數值為11001010,將該寄存器小循環(huán)左移一位后,結果為( )A.01100101B.10010100C.10010101D.011001006.動態(tài)存儲器的特點是 ()A. 工作中存儲內容會產生變化B. 工作中需要動態(tài)改變訪存地址C.工作中需要動態(tài)地改變供電電壓D. 需要定期刷新每個存儲單元
3、中存儲的信息7.組相聯(lián)映象和全相聯(lián)映象通常適合于()A. 小容量 CacheB.大容量 CacheC.小容量 ROMD.大容量 ROM8.在大多數情況下,一條機器指令中是不直接用二進制代碼來指定()A. 下一條指令的地址B. 操作的類型C.操作數地址D. 結果存放地址9.在存儲器堆棧中,若棧底地址為A, SP 指針初值為A - 1,當堆棧采用從地址小的位置向地址大的位置生成時,彈出操作應是()A. 先從堆棧取出數據,然后SP 指針減 11精品自學考試資料推薦B. 先從堆棧取出數據,然后SP 指針加 1C.SP 指針先加1,然后從堆棧取出數據D.SP 指針先減1,然后從堆棧取出數據10.轉移指令
4、執(zhí)行結束后,程序計數器PC 中存放的是 ()A. 該轉移指令的地址B.順序執(zhí)行的下條指令地址C.轉移的目標地址D.任意指令地址11.通常,微指令的周期對應一個()A. 指令周期B.主頻周期C.機器周期D.工作周期12.波特率表示傳輸線路上()A. 信號的傳輸速率B.有效數據的傳輸速率C.校驗信號的傳輸速率D.干擾信號的傳輸速率13.不同信號在同一條信號線上分時傳輸的方式稱為()A. 總線復用方式B. 并串行傳輸方式C.并行傳輸方式D. 串行傳輸方式14.24 針打印機的打印頭的針排列是 ( )A.24 根針排成一列B.24 根針排成2 列C.24 根針排成 3 列D.24 根針排成4 列15.
5、在常用磁盤的各磁道中()A. 最外圈磁道的位密度最大B. 最內圈磁道的位密度最大C.中間磁道的位密度最大D. 所有磁道的位密度一樣大第二部分非選擇題 (共 85 分)二、填空題 (本大題共 5 小題,每小題2 分,共 10 分 )16.采用 DMA 方式傳送數據是由DMA接口來控制數據在_和 _之間傳輸。17.按照傳輸定時的方法劃分,總線數據通信方式可分為_和 _兩類。18.構成中央處理器的兩大部件是_和 _。19.在微程序控制器中,控制存儲器由_構成,用于存放 _。20.磁盤存儲設備主要由磁記錄介質、_和 _三個部分組成。三、名詞解釋題 (本大題共 5 小題,每小題 2 分,共 10 分 )
6、21.應用軟件22.偶校驗碼23.微程序控制器24.總線從設備25.通道程序四、簡答題 (本大題共6 小題,每小題5 分,共 30 分 )26.簡述靜態(tài)存儲器的寫操作過程。27.假設寄存器R 中的數值為2000,主存地址為2000 和 3000 的地址單元中存放的內容分別2精品自學考試資料推薦為 3000 和 4000, PC 的值為 5000,若按以下尋址方式,訪問到的操作數各是多少?寄存器尋址R;寄存器間接尋址(R) ;直接尋址2000;存儲器間接尋址(2000) ;相對尋址 - 3000(PC) 。28.硬連線控制器主要由哪幾部分構成?它是如何產生控制信號的?29.系統(tǒng)總線接口有哪幾項基
7、本功能?30.基本的 DMA 控制器的主要部件有哪些?31.簡述多重中斷系統(tǒng)中CPU 響應處理一次中斷的步驟。五、計算題 (本大題共1 小題, 10 分 )32.用原碼加減交替一位除法進行72 運算。要求寫出每一步運算過程及運算結果。六、設計題 (本大題共 2 小題,第33 小題 15 分,第 34小題 10 分,共 25 分 )33.用 644 位 /片的 SRAM 存儲器芯片設計一個總容量為256 字節(jié)存儲器, CPU 地址總線為A 15 A0 (低位 ),雙向數據總線D 7 D0(低位 ),讀寫控制信號為 R/ W ,芯片的片選控制信號為 CS 。請寫出片選信號邏輯式,繪出該存儲器邏輯框圖,注明各信號線。34.單總線 CPU 結構如下圖所示,其中有運算部件 ALU 、寄存器 Y 和 Z,通用寄存器 R0R3、指令寄存器 IR
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