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1、3.1 基本邏輯門電路基本邏輯門電路3.2 TTL數(shù)字集成邏輯門電路數(shù)字集成邏輯門電路3.3 ECL邏輯門電路(邏輯門電路(*)3.4 CMOS邏輯門電路(邏輯門電路(*)3.5 數(shù)字集成電路使用中應注意的問題數(shù)字集成電路使用中應注意的問題下一頁上一頁章目錄下一頁上一頁章目錄100VUCC高電平高電平低電平低電平下一頁上一頁章目錄下一頁上一頁章目錄BAbc下一頁上一頁章目錄V0 5-0.7-0.7 =3.6V輸入有低輸入有低“0”輸出輸出為高為高“1”BAbc下一頁上一頁章目錄ABF 輸入全高輸入全高“1”,輸出為輸出為低低“0”“0”(0.3V)下一頁上一頁章目錄下一頁上一頁章目錄下一頁上一
2、頁章目錄下一頁上一頁章目錄下一頁上一頁章目錄下一頁上一頁章目錄下一頁上一頁章目錄下一頁上一頁章目錄下一頁上一頁章目錄16116 ILOL1 IIN1004. 04 . 0 IHOH2 IIN下一頁上一頁章目錄50%50%tPHLtPLH2 2p pd dPLHPHLttt 輸入波形輸入波形ui輸出波形輸出波形uO下一頁上一頁章目錄下一頁上一頁章目錄下一頁上一頁章目錄74LS20(4輸入輸入2門門)&UCCD2C2B2Y214C1D1Y1B1A1GND13121110 9 81234567A2&下一頁上一頁章目錄下一頁上一頁章目錄F+5V T4AB R3R2R1T2 T1RLVC
3、C&YBA下一頁上一頁章目錄Y1 =AB Y2 = CDCDABCDABYYY21下一頁上一頁章目錄Y&CBAKA+24VKA220下一頁上一頁章目錄IHOHOH(min)CC)max(MINIVVRL 1VOHVIL1VOHVIL1VOHVIL1下一頁上一頁章目錄1VIL1VOLVIH1VIL1ILOL(max)OL(max)CCL(min)VVIMIR 下一頁上一頁章目錄T3T4截止截止下一頁上一頁章目錄1V1VT3T4導通導通下一頁上一頁章目錄控制端高電平有效的三態(tài)門控制端高電平有效的三態(tài)門控制端低電平有效的三態(tài)門控制端低電平有效的三態(tài)門用用“”表示輸出表示輸出為三態(tài)。為三態(tài)。下一頁上一頁章目錄下一頁上一頁章目錄 “1”“0”“0”11BA AY下一頁上一頁章目錄,時時0 E,時時1 EAY BY 下一頁上一頁章目錄ABAF2B=1下一頁上一頁章目錄下一頁上一頁章目錄=VE- -(- -VEE)/Re 10mA下一頁上一頁章目錄=VE- -(- -VEE)/Re 10.6mA下一頁上一頁章目錄下一頁上一頁章目錄AY1下一頁上一頁章目錄ABT3T1T4T2+UDDYBAY 下一頁上一頁章目錄T1T3T2T4+UDDBAY 下一頁上一頁章目錄下一頁上一頁章目錄下一頁上一頁章目錄下一頁上一頁章目錄下一頁上一頁章目錄下一頁上一頁章目錄下一頁上一頁章目錄下一頁上一頁
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