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文檔簡介

1、EDA 實驗報告實驗一 七段數(shù)碼顯示譯碼器 2實驗?zāi)康?. 學(xué)會的破解 quartusII 方法并破解機房電腦。2. 掌握七段數(shù)碼顯示譯碼器的工作原理并能夠用 virlog 語言編程。3. 初步了解 quartusII 建立程序編譯、仿真及下載的操作流程并學(xué)會七段數(shù)碼顯示譯碼器的 Verilog 硬件設(shè)計。實驗步驟1. 新建 Verilog 工程,編寫代碼并保存至與模塊名對應(yīng)的文件夾。注意:項目應(yīng)存為系統(tǒng) 盤以外的盤內(nèi),路徑中不含中文字符。2. 編譯程序,編譯無誤后,在【tools 【netlist viewers】里面選擇 RTL視,觀察電路結(jié) 構(gòu)。3. 新建波形文件進行仿真。 保存時要和源

2、程序存放在同一目錄下。 設(shè)置好輸入波形參數(shù)后, 開始仿真。在仿真后輸入輸出波形中觀察邏輯關(guān)系是否正確。4. 將實驗箱和 PC 合理連接起來。 打開 EDA6000 軟件,設(shè)置好芯片類型為 ACEX1K(EP1K10 TC144-3),載入模式4.5. 根據(jù)EDA 6 0 0 0界面內(nèi)管腳對應(yīng)芯片的實際管腳在QUARTUSII里面設(shè)定管腳號并檢查無誤。6. 將程序下載至FPGA內(nèi),并在EDA6 0 0 0軟件界面內(nèi)進行驗證測試。程序代碼module digital7 (A,Y);4H0: Y=7B0111111;input 3:0A;4H1: Y=7B0000110;output 6:0Y;4H

3、2: Y=7B1011011;reg 6:0Y;4H3: Y=7B1001111;always (A)4H4:Y=7B1100110;begin4H5:Y=7B1101101;case (A)4H6:Y=7B1111101;/gfedcba/4H7:Y=7B0000111;4H8: Y=7B1111111;4H9: Y=7B1101111;4HA: Y=7B1101111;4HB: Y=7B1111100;4HC: Y=7B0111001;4HD: Y=7B1011110;4HE: Y=7B1111001;4HF: Y=7B1110001; default: Y=7Bxxxxxxx endca

4、se end en dmodule編譯結(jié)果 匚RepdiI - rbw SurvnayFlaw Wmury F1m | * Bwgi bife |SJ1 jjTfiaiiii fljqxrt 爭曲 Lstrttm HwSumay 些聞伽Seffinp SSI Flm W 占i 也 Settr 駟 FlwELpwd 怯 毋因Flwbog*闿lVi#|f95 hSfirthBB+暑Fttsr卜尋J址卜尋liw ArdyMfnw |fdiTufcHff* 口 St環(huán) Frjeri.Flcr SthtnSiozinfil - TJ lu-:】LE!tt:(n SQIJQiatLe. I Ttril-i

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