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文檔簡介
1、第6章 時序邏輯電路61從概念,結(jié)構(gòu)和功能描述等幾個方面簡述時序邏輯電路和組合邏輯電路的不同。 概念:組合邏輯電路在任一時刻的輸出僅由該時刻的輸入決定,而與過去的狀態(tài)無關(guān),電路 無記憶功能。時序邏輯電路任一時刻的輸出信號不僅取決于該時刻的輸入信號,而且還取決 于電路原來的狀態(tài)。結(jié)構(gòu):組合電路都是單純由邏輯門組成,且輸出不存在反饋路徑。時序邏輯電路由組合邏輯 電路和存儲電路組成,輸出和輸入之間有反饋。存儲電路一般由觸發(fā)器構(gòu)成。X2X1/Z0X/0 11/1.A 10/0_11/001/1/C L00/001/0功能描述:組合邏輯電路一般用邏輯圖、邏輯表達(dá)式和真值表描述。時序邏輯一般用邏輯圖、 邏
2、輯方程式(狀態(tài)方程、輸出方程、驅(qū)動方程)、狀態(tài)轉(zhuǎn)換表、狀態(tài)轉(zhuǎn)換圖和時序圖來描述。 62 作出與表1所示狀態(tài)表對應(yīng)的狀態(tài)圖?,F(xiàn)態(tài)次態(tài)yi c輸出工y.zyi工莊::如小蝦仁二航二HAB/0B/0A/lB/0BB/0C/lA/0D/lcc/oB/0D/0A/0DVoA/lC/0C/0去1狀志表00/0/00/001/1D 10/63用邊沿觸發(fā)D觸發(fā)器和與非門設(shè)計(jì)一個三位右移寄存器,用一控制端X控制,當(dāng)X = 0時能串行輸入新數(shù)據(jù)DI,當(dāng)X = 1時具有自循環(huán)功能。117 QQ1Q、0001TXr3XXXXXXXX1000011110答:由題意知,計(jì)數(shù)器是由右移寄存器實(shí)現(xiàn)的,所以只要確定第一個JK觸
3、發(fā)器的驅(qū)動方程64完成下列設(shè)計(jì):.畫出用J-K觸發(fā)器實(shí)現(xiàn)的四位右移寄存器的邏輯圖(數(shù)據(jù)向高位移位定義為右移,寄存器的輸出Q1 Q 2 Q 3 Q4,設(shè)Q 4為高位。.用上述四位右移寄存器實(shí)現(xiàn)下列計(jì)數(shù)器,寫出設(shè)計(jì)步驟,畫出邏輯圖。CPQ1 Q2 Q3 Q4 TOC o 1-5 h z 0000011000201003101040101500106000170000根據(jù)給出的狀態(tài)轉(zhuǎn)換表,可得卡諾圖?;喌肈t = Q Q Q. = Q_十Q3十Q4即可。CP65用一片74LS161和必要的門電路構(gòu)成一個可控計(jì)數(shù)器。當(dāng)控制端C=1時,實(shí)現(xiàn)八進(jìn)制計(jì)數(shù);C=0時,實(shí)現(xiàn)四進(jìn)制數(shù)。答:本題由多種解法,即可以
4、采用置數(shù)法,也可以采用復(fù)位法。下圖為采用進(jìn)位輸出置數(shù)法 實(shí)現(xiàn)的一種方法。將控制端C加在置數(shù)端,當(dāng)C=1時,置數(shù)端為1000,當(dāng)C=0時,置數(shù) 端為1100。進(jìn)位位接置數(shù)控制端,一旦計(jì)數(shù)值為1111,則下一個脈沖來時產(chǎn)生進(jìn)位位使置 數(shù)控制端有效,計(jì)數(shù)值變?yōu)橹脭?shù)值。(設(shè)計(jì)過程略),11111CPJepQ0 Q1Q2Q3 CET 74LS161 了dDoDi D2D3LDCPQ a Qb Qc QdP1 74LS290圖6.13答:該電路為10進(jìn)制計(jì)數(shù)器,能夠自啟動。狀態(tài)圖中無效狀態(tài)略。1、波形圖略,狀態(tài)轉(zhuǎn)換圖如下:110010111010100110002、該編碼為5421碼。3、該編碼為先偶數(shù)再奇數(shù)的編碼方式,狀態(tài)轉(zhuǎn)換圖如下:廠、QnQnQnQn/ 0110 一1000廠、廠、10010111 F0011T00010000 0010614圖5.14為由集成異步計(jì)數(shù)器74LS90、74LS93構(gòu)成的電路,試分別說明它們是多少進(jìn)制的計(jì)數(shù)器。(74LS90功能與74LS290完全相同;74LS93相關(guān)資料請自己查找。)CPQa Qb Qc Qd1 74LS90CP0 S S RR9T920nrCPPP1PP0b c d 74LS93 R圖6.14(a)圖6.14(b)DQ-IT;CP&PP1CP074LS90S S RR9112
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